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燦芯半導體推出通用高性能小數分頻鎖相環IP

燦芯半導體BriteSemi ? 來源:燦芯半導體BriteSemi ? 2024-07-09 14:13 ? 次閱讀

2024年07月09日,一站式定制芯片及IP供應商——燦芯半導體(上海)股份有限公司(燦芯股份,688691)宣布成功研發出一款通用高性能小數分頻鎖相環(fractional-N PLL)IP,支持24bits高精度小數分頻,最高輸出頻率4.5Ghz,另外還支持擴頻時鐘(SSC)功能,可以為客戶提供多功能的小數分頻 PLL解決方案。

PLL電路一般用于產生輸出頻率,輸出頻率值與PLL的參考輸入頻率呈倍數關系。小數分頻PLL通過頻率乘法比例的小數值,實現更精確的輸出頻率控制,從而提供更高精度和準確度的輸出頻率。

SSC發生器是在一定頻率范圍內調制時鐘信號頻率的電路,將時鐘信號的能量擴展到更大的頻率范圍上。這種調制技術可以減少電磁干擾(EMI),提高信號的完整性。隨著集成電路工藝節點的不斷減小,市場對這類支持SSC功能的小數分頻PLL IP需求也在不斷增加,這種設計具有減少電磁干擾、提高時鐘穩定性和降低功耗的優點。

“基于十多年IP設計開發的成功經驗,燦芯半導體成功研發出通用高性能小數分頻PLL IP。該PLL IP支持較寬的輸入輸出頻率范圍,具有優異的抖動性能,可以應用于任何時鐘應用場景,特別是混合噪聲信號的SoC環境。這款高性能小數分頻 PLL IP已經成功在28nm工藝上流片,并且成功完成測試芯片驗證,目前這款高性能小數分頻PLL IP已經被多家客戶使用。

關于燦芯半導體

燦芯半導體(上海)股份有限公司(燦芯股份,688691)是一家提供一站式定制芯片及IP的高新技術企業,為客戶提供從芯片架構設計到芯片成品的一站式服務,致力于為客戶提供高價值、差異化的解決方案。

燦芯半導體的“YOU”系列IP和YouSiP(Silicon-Platform)解決方案,經過了完整的流片測試驗證。其中YouSiP方案可以為系統公司、無廠半導體公司提供原型設計參考,從而快速贏得市場。

燦芯半導體成立于2008年,總部位于中國上海,為客戶提供全方位的優質服務。

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原文標題:燦芯半導體發布通用高性能小數分頻鎖相環IP及相關解決方案

文章出處:【微信號:BriteSemi,微信公眾號:燦芯半導體BriteSemi】歡迎添加關注!文章轉載請注明出處。

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