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Abstract - We review the evolution of DSP architectures and compiler technology, and
describe how compiler techniques are being used to optimize emerging DSP architectures. Such
new architectures are characterized by the exploitation of data and instruction level parallelism
while being an amenable target for a compiler, thereby reducing or eliminating the need to rely
on assembly language programming and/or architecture-specific compiler intrinsics to achieve
highly efficient code. We also summarize our research results on an ultra-low power compilable
DSP architecture.
describe how compiler techniques are being used to optimize emerging DSP architectures. Such
new architectures are characterized by the exploitation of data and instruction level parallelism
while being an amenable target for a compiler, thereby reducing or eliminating the need to rely
on assembly language programming and/or architecture-specific compiler intrinsics to achieve
highly efficient code. We also summarize our research results on an ultra-low power compilable
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