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DMA總線
此總線將DMA的AHB主控接口與總線矩陣相聯，總線矩陣協調著CPU的DCode和DMA到
SRAM、閃存和外設的訪問。
總線矩陣
此總線矩陣協調內核系統總線和DMA主控總線之間的訪問仲裁。此仲裁利用輪換算法。此總線
矩陣由四個驅動部件（CPU的DCode、系統總線、DMA1總線和DMA2總線）和四個被動部件（閃存
存儲器接口（FLITF）、SRAM、FSMC和AHB2APB橋）構成。
AHB外設通過總線矩陣與系統總線相連，允許DMA訪問。
AHB/APB橋（APB）
兩個AHB/APB橋在AHB和2個APB總線間提供同步連接。APB1操作速度限于36MHz，APB2操
作于全速（最高72MHz）。
有關連接到每個橋的不同外設的地址映射請參考表1。在每一次復位以后，所有除SRAM和
FLITF以外的外設都被關閉，在使用一個外設之前，必須設置寄存器RCC_AHBENR來打開該外
設的時鐘。
意： 當對APB寄存器進行8位或者16位訪問時，該訪問會被自動轉換成32位的訪問：橋會自動將8位
或者32位的數據擴展以配合32位的向量。
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