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在許多數(shù)據(jù)采集應(yīng)用中，必須有一個A到D轉(zhuǎn)換器作為其最大轉(zhuǎn)換速率工作。然后，控制微處理器將能夠在軟件要求的任何時間點讀取最新的輸入數(shù)據(jù)。為了最小化程序執(zhí)行時間，數(shù)據(jù)讀取可能與轉(zhuǎn)換完成不同步，這存在一個問題。在A/D轉(zhuǎn)換器正在更新其輸出寄存器的瞬間，處理器完全可以斷言讀命令。所讀取的數(shù)據(jù)將是轉(zhuǎn)換器的輸出線在從先前轉(zhuǎn)換的結(jié)果到最新結(jié)果的轉(zhuǎn)換中的值，并且很可能是錯誤的。
向A/D接口電路中添加一個簡單的二進制計數(shù)器可以用來生成微處理器的就緒信號，這將防止在數(shù)據(jù)更新期間讀取。圖1的電路顯示了一個CD4024BC7 緩沖器進位二進制計數(shù)器，它與ANADC0801、8位微處理器兼容的A到D轉(zhuǎn)換器一起使用。電路操作依賴于A/D轉(zhuǎn)換器的兩個基本屬性。首先，A/D的自由運行轉(zhuǎn)換時間必須是一個恒定的時鐘周期數(shù)；其次，輸出鎖存器必須在轉(zhuǎn)換信號結(jié)束之前被更新。ADC0801滿足這兩個要求。在ITO低電平之前，輸出數(shù)據(jù)鎖存器被更新一個A/DCK周期，并且自由運行轉(zhuǎn)換時間總是72個時鐘周期長。
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