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許多現(xiàn)代數(shù)據(jù)采集系統(tǒng)由高速、高分辨率的ADC組成，由于低成本和低功耗，經(jīng)常選擇1個CMOS開關(guān)、電容器基礎(chǔ)ADC來進行這種設計。這些ADC使用無緩沖的前端直接耦合到采樣網(wǎng)絡。為了有效地減小噪聲和信號失真，需要用高速、低噪聲、低失真的運算放大器來驅(qū)動ADC。2為了實現(xiàn)微小失真，在ADC的采集時間內(nèi)，運算放大器輸出要達到期望的精度是很重要的。通常，運算放大器的穩(wěn)定時間是根據(jù)數(shù)據(jù)表中指定的頻率響應來計算的，或者用具有限制分辨率的示波器探測輸出來測量。有時放大運算放大器的輸入和輸出之間的差異，以達到更好的精度。這些方法受到示波器分辨率或寄生電路的限制，而且放大器的穩(wěn)定時間受示波器探頭引入的寄生電容和電感的影響。在另一種方法中，放大輸出和輸入之間的差異以增加測量的分辨率。這些方法都不包括ADC采樣電路和封裝中存在的寄生電容和電感。
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