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用VHDL 語(yǔ)言在FPGA 內(nèi)部編程實(shí)現(xiàn)組播復(fù)制。本文介紹其實(shí)現(xiàn)方法，并給出了時(shí)序仿真波形。
通過擴(kuò)展，該設(shè)計(jì)可以支持多位寬、多路復(fù)制，因而具有較好的應(yīng)用前景。
關(guān)鍵詞：FPGA VHDL 組播復(fù)制
組播是一種數(shù)據(jù)包傳輸方式，當(dāng)有多臺(tái)主機(jī)同時(shí)成為一個(gè)數(shù)據(jù)包的接受者時(shí)，出于對(duì)帶
寬和CPU 負(fù)擔(dān)的考慮，組播成為了一種最佳選擇。在T 比特路由器4X2.5G 線路接口模塊
的硬件實(shí)現(xiàn)中，我們需要將數(shù)據(jù)發(fā)送到不同的目的端口，而這些端口又不是所有的目的端口。
根據(jù)數(shù)據(jù)攜帶的組播目的端口號(hào)可以實(shí)現(xiàn)數(shù)據(jù)的復(fù)制，這就是本文所提到的組播復(fù)制。我們用VHDL 語(yǔ)言在FPGA 內(nèi)部編程將其實(shí)現(xiàn)。本文第2 節(jié)給出用VHDL 語(yǔ)言在FPGA 內(nèi)部編程實(shí)現(xiàn)組播復(fù)制的過程，第3 節(jié)總結(jié)全文。
通過擴(kuò)展，該設(shè)計(jì)可以支持多位寬、多路復(fù)制，因而具有較好的應(yīng)用前景。
關(guān)鍵詞：FPGA VHDL 組播復(fù)制
組播是一種數(shù)據(jù)包傳輸方式，當(dāng)有多臺(tái)主機(jī)同時(shí)成為一個(gè)數(shù)據(jù)包的接受者時(shí)，出于對(duì)帶
寬和CPU 負(fù)擔(dān)的考慮，組播成為了一種最佳選擇。在T 比特路由器4X2.5G 線路接口模塊
的硬件實(shí)現(xiàn)中，我們需要將數(shù)據(jù)發(fā)送到不同的目的端口，而這些端口又不是所有的目的端口。
根據(jù)數(shù)據(jù)攜帶的組播目的端口號(hào)可以實(shí)現(xiàn)數(shù)據(jù)的復(fù)制，這就是本文所提到的組播復(fù)制。我們用VHDL 語(yǔ)言在FPGA 內(nèi)部編程將其實(shí)現(xiàn)。本文第2 節(jié)給出用VHDL 語(yǔ)言在FPGA 內(nèi)部編程實(shí)現(xiàn)組播復(fù)制的過程，第3 節(jié)總結(jié)全文。
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