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針對數(shù)據(jù)加密算法的硬件設計，主要討論了一個基于PCI 總線的數(shù)據(jù)加密系統(tǒng)的設
計與實現(xiàn)過程。首先對系統(tǒng)體系結構以及在FPGA 芯片內(nèi)部對PCI 接口模塊的實現(xiàn)進行了
分析，然后，采用硬件描述語言描述3DES 算法、PCI 接口模塊及控制模塊，重點是在FPGA芯片內(nèi)部的加解密模塊部分對3DES 加密算法進行了硬件平臺上的設計與實現(xiàn)，即通過硬件描述語言和EDA 開發(fā)平臺將3DES 算法實現(xiàn)到FPGA 當中，作為一個主要的功能模塊完成了對數(shù)據(jù)的加解密過程。此外，對系統(tǒng)的主要功能部分還進行了一些仿真測試。結果表明，加密系統(tǒng)性能穩(wěn)定、結構可靠
計與實現(xiàn)過程。首先對系統(tǒng)體系結構以及在FPGA 芯片內(nèi)部對PCI 接口模塊的實現(xiàn)進行了
分析，然后，采用硬件描述語言描述3DES 算法、PCI 接口模塊及控制模塊，重點是在FPGA芯片內(nèi)部的加解密模塊部分對3DES 加密算法進行了硬件平臺上的設計與實現(xiàn)，即通過硬件描述語言和EDA 開發(fā)平臺將3DES 算法實現(xiàn)到FPGA 當中，作為一個主要的功能模塊完成了對數(shù)據(jù)的加解密過程。此外，對系統(tǒng)的主要功能部分還進行了一些仿真測試。結果表明，加密系統(tǒng)性能穩(wěn)定、結構可靠
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