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在前面的實驗里，我們所有的實驗都是基于這樣一個觀點，即將一個數字系統劃分成合適利用已有的中小規模數字集成電路的功能的模塊，然后將這些集成電路通過外部引線連接起來。現在開始我們將研究用可編程邏輯器件(PLD/FPGA)來進行數字系統設計。可編程邏輯器件是一種大規模的集成電路，其內部預置了大量易于實現各種邏輯函數的結構，同時還有一些用來保持信息或控制連接的特殊結構，這些保持的信息或連接確定了器件實現的實際邏輯功能，當改變這些信息或連接時器件的功能也將隨之改變。可編程邏輯器件的設計過程和傳統的中小規模數字電路設計也不一樣，可編程數字系統，無論是CPLD還是FPGA器件都需要利用軟件工具來進行設計。可編程數字系統設計總體上一般可以分為設計輸入、項目處理、設計校驗和器件編程這四個主要過程。下面我們將一個簡單的模60BCD計數器為例，說明可編程數字系統設計的基本流程、概念和方法，掌握Quartus II軟件的基本功能和操作，了解原理圖輸入方式的設計全過程。
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