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發(fā)視頻如何學(xué)習(xí)FPGA學(xué)習(xí)FPGA的詳細(xì)經(jīng)驗(yàn)有哪些階段
資料介紹
學(xué)習(xí)FPGA我主要經(jīng)歷了這么幾個(gè)階段：
①、Verilog語(yǔ)言的學(xué)習(xí)，熟悉Verilog語(yǔ)言的各種語(yǔ)法。
②、FPGA的學(xué)習(xí)，熟悉QuartusII軟件的各種功能，各種邏輯算法設(shè)計(jì)，接口模塊（RS232，LCD，VGA，SPI，I2c等）的設(shè)計(jì)，時(shí)序分析，硬件優(yōu)化等，自己開始設(shè)計(jì)簡(jiǎn)單的FPGA板子。
③、NiosII的學(xué)習(xí)，熟悉NiosII的開發(fā)流程，熟悉開發(fā)軟件（SOPC，NiosII IDE），了解NiosII的基本結(jié)構(gòu)，設(shè)計(jì)NiosII開發(fā)板，編寫NiosII C語(yǔ)言程序，調(diào)試板子各模塊功能。
先來(lái)說(shuō)說(shuō)第一個(gè)階段，現(xiàn)在主要的硬件描述語(yǔ)言有VHDL，Verilog兩種，在本科時(shí)老師一般教VHDL，不過(guò)現(xiàn)在
Verilog用的人越來(lái)越多，其更容易上手（與C語(yǔ)言語(yǔ)法比較類似），也更靈活，現(xiàn)在的IC設(shè)計(jì)基本都用Verilog。像systemC，systemVerilog之類的應(yīng)該還在萌芽階段，
以后可能會(huì)有較大發(fā)展。鑒于以上原因我選擇了Verilog作為我學(xué)習(xí)的硬件描述語(yǔ)言。
其實(shí)有C語(yǔ)言的基礎(chǔ)，學(xué)起Verilog的語(yǔ)言很簡(jiǎn)單，關(guān)鍵要有并行的概念，所有的module，assign，always都是并行的，這一點(diǎn)與軟件語(yǔ)言有明顯不同。
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