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發(fā)視頻FPGA視頻教程之在SF-EP1C開發(fā)板進(jìn)行AS和JTAG配置方式的詳細(xì)資料介紹
2019-03-05 |
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資料介紹
AS和JTAG配置方式
與CPLD不同，FPGA是基于SRAM結(jié)構(gòu)的（Actel也有基于Flash結(jié)構(gòu)的FPGA，但不是今天討論的重點(diǎn)），所以FPGA每次上電都需要重新配置，而不像CPLD那樣能夠直接運(yùn)行固化在芯片內(nèi)的代碼。大家對(duì)JTAG的下載也許都很熟悉了，但是轉(zhuǎn)到FPGA的時(shí)候多多少少有些迷惑。怎么出現(xiàn)配置芯片了呢？為什么有不同的下載電纜，不同的下載模式呢？
FPGA器件有三類配置下載方式：主動(dòng)配置方式（AS）、 被動(dòng)配置方式（PS）和最常用的基于JTAG的配置方式。
AS方式由FPGA器件引導(dǎo)配置操作過程，它控制著外部存儲(chǔ)器和初始化過程，EPCS系列配置芯片如EPCS1、EPCS4等配置器件專供AS模式。使用Altera串行配置器件來完成，F(xiàn)PGA 器件處于主動(dòng)地位，配置器件處于從屬地位。配置數(shù)據(jù)通過DATAO引腳送入FPGA。配置數(shù)據(jù)被同步在DCLK輸入上，1個(gè)時(shí)鐘周期傳送1位數(shù)據(jù)。
PS方式則由外部計(jì)算機(jī)或其它控制器控制配置過程。通過加強(qiáng)型配置器件（EPC16，EPC8， EPC4） 等配置器件來完成，在PS配置期間，配置數(shù)據(jù)從外部?jī)?chǔ)存部件通過DATAO引腳送入FPGA.配置數(shù)據(jù)在DCLK上升沿鎖存，1個(gè)時(shí)鐘周期傳送1位數(shù)據(jù)。
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