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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA視頻教程之基于SDRAM讀寫的串口調試實驗說明

FPGA視頻教程之基于SDRAM讀寫的串口調試實驗說明

2019-03-06 | rar | 0.00 MB | 次下載 | 免費

資料介紹

  SF-EPIC開發板上使用的是三星SDR SDRAM (K4S641632)。由于控制SDRAM的讀寫不同于之前的很多簡單接口實驗(它們對時序的要求都不高,即便不做時序約束也無關緊要),SDRAM的時鐘沿和數據總線、地址總線以及控制總線都存在嚴格的時序關系,尤其當頻率較高(我們的設計中達到了100MHz,接近了該器件標稱的133MHz的最高頻率)時,稍有閃失就會造成通信的不正常。

  該實例的核心是設計一個SDRAM控制器。首先,設計者需要對這個控制器內部的邏輯功能做細分,將其劃分為多個子模塊來實現。如圖5. 77所示,sdram ctrl是SDRAM狀態控制模塊,該模塊主要完成SDRAM的上電初始化以及定時刷新、讀寫控制等狀態的變遷,內部設計了兩個狀態機,一個用于上電初始化的狀態控制,另一個則用于正常工作時的狀態控制:sdram _cmd是SDRAM 命令模塊,該模塊根據sdram ctrl 模塊的不同狀態指示輸出相應的SDRAM控制命令和地址(控制總線信號如sdram cke、sdram cs. nsdram we n.sdram ras_ n、sdram cas n,地址總線信號sdram addr); sdram wr data是SDRAM數據讀寫模塊,該模塊同樣是根據sdram ctrl模塊的狀態指示完成SDRAM數據總線的控制,SDRAM 的數據讀寫都在該模塊完成。

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