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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>為什么高速ADC會(huì)有這么多的電源軌和電源域

      為什么高速ADC會(huì)有這么多的電源軌和電源域

      2021-01-08 | pdf | 0.53 MB | 次下載 | 3積分

      資料介紹

      　　在采樣速率和可用帶寬方面，當(dāng)今的射頻模數(shù)轉(zhuǎn)換器（RF ADC）已有長(zhǎng)足的發(fā)展。其中還納入了大量數(shù)字處理功能，電源方面的復(fù)雜性也有提高。那么，當(dāng)今的 RF ADC 為什么有如此多不同的電源軌和電源域？為了解電源域和電源的增長(zhǎng)情況，我們需要追溯 ADC 的歷史脈絡(luò)。早在 ADC 不過爾爾的時(shí)候，采樣速度很慢，大約在數(shù)十 MHz 內(nèi)，而數(shù)字內(nèi)容很少，幾乎不存在。電路的數(shù)字部分主要涉及如何將數(shù)據(jù)傳輸?shù)綌?shù)字接收邏輯——專用集成電路 （ASIC） 或現(xiàn)場(chǎng)可編程門陣列 （FPGA）。用于制造這些電路的工藝節(jié)點(diǎn)幾何尺寸較大，約在 180 nm 或更大。使用單電壓軌（1.8 V ）和兩個(gè)不同的域（AVDD 和 DVDD，分別用于模擬域和數(shù)字域），便可獲得足夠好的性能。隨著硅處理技術(shù)的改進(jìn)，晶體管的幾何尺寸不斷減小，意味著每 mm2 面積上可以容納更多的晶體管（即特征）。但是，人們?nèi)匀幌Ｍ?ADC 實(shí)現(xiàn)與其前一代器件相同（或更好）的性能。現(xiàn)在，ADC 的設(shè)計(jì)采取了多層面方法，其中： 1. 采樣速度和模擬帶寬必須得到改善； 2. 性能必須與前一代相同或更好； 3. 納入更多片內(nèi)數(shù)字處理功能來輔助數(shù)字接收邏輯。下面將進(jìn)一步討論上述各方面特性以及它們對(duì)芯片設(shè)計(jì)構(gòu)成怎樣的挑戰(zhàn)。

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