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?本文基于FPGA平臺(tái)設(shè)計(jì)并實(shí)現(xiàn)了一種嵌入式16位RISC CPU核。以MIPS CPU指令集為參考,完成指令集設(shè)計(jì);對指令處理過程進(jìn)行抽象,把指令分成取指、譯碼、執(zhí)行、訪存、寫回五級流水處理,根據(jù)處理過程所需要的元件構(gòu)建五級數(shù)據(jù)通路;針對流水線處理產(chǎn)生的數(shù)據(jù)相關(guān)構(gòu)建旁路通路;根據(jù)五級數(shù)據(jù)通路及旁路通路所需要的協(xié)調(diào)信號構(gòu)建控制通路;把數(shù)據(jù)通路和控制通路融合成CPU核。采用VHDL實(shí)現(xiàn)CPU核;在CPU核上運(yùn)行測試程序,并給出仿真結(jié)果;在FPGA平臺(tái)上對CPU核進(jìn)行驗(yàn)證。結(jié)果表明了所設(shè)計(jì)CPU核的有效性。
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