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設(shè)計(jì)驗(yàn)證中的隨機(jī)約束

2009-12-14 | rar | 455 | 次下載 | 3積分

資料介紹

隨機(jī)約束在現(xiàn)代集成電路驗(yàn)證中已得到國(guó)際IC 設(shè)計(jì)業(yè)界的普遍認(rèn)可,并逐漸開
始普及。與傳統(tǒng)的定向測(cè)試比較,它在驗(yàn)證效率、驗(yàn)證覆蓋率等方面具有諸多
優(yōu)勢(shì)。最新公布的SystemVerilog IEEE 標(biāo)準(zhǔn)中,包含了對(duì)隨機(jī)約束的支持。本
文舉例說明了隨機(jī)約束的優(yōu)點(diǎn)、使用方法及其與斷言和功能覆蓋率相輔相成的
關(guān)系。目前國(guó)內(nèi)已有一些設(shè)計(jì)單位開始將隨機(jī)約束應(yīng)用于設(shè)計(jì)驗(yàn)證中,本文的
宗旨是介紹我們的成功經(jīng)驗(yàn)以推動(dòng)這種新的驗(yàn)證方法在國(guó)內(nèi)的推廣和普及。
關(guān)鍵字:隨機(jī)約束,SystemVerilog,功能覆蓋率
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