此案例來源于：創(chuàng)龍科技

測試板卡為：TI Sitara系列AM5728+ Xilinx Artix-7 FPGA開發(fā)板

前  言

本文主要介紹基于FPGA + MicroBlaze裸機(jī)案例的使用說明，適用開發(fā)環(huán)境：Windows 7/10 64bit、Xilinx Vivado 2017.4、Xilinx SDK 2017.4。FPGA + MicroBlaze裸機(jī)綜合案例分為FPGA程序與MicroBlaze裸機(jī)程序兩部分。

評估板簡介

創(chuàng)龍科技TL5728F-EVM是一款基于TI Sitara系列AM5728（雙核ARM Cortex-A15 +浮點(diǎn)雙核DSP C66x） + Xilinx Artix-7 FPGA處理器設(shè)計的高端異構(gòu)多核評估板，由核心板與評估底板組成。AM5728與Artix-7在核心板內(nèi)部通過GPMC、I2C通信總線連接，在評估底板通過PCIe通信總線連接。核心板經(jīng)過專業(yè)的PCB Layout和高低溫測試驗證，穩(wěn)定可靠，可滿足各種工業(yè)應(yīng)用環(huán)境。

評估板接口資源豐富，引出雙路千兆網(wǎng)口、雙路SFP光口、USB 3.0、CAN、RS485、SATA、HDMI、GPMC、FMC等接口，方便用戶快速進(jìn)行產(chǎn)品方案評估與技術(shù)預(yù)研。

目  錄
前  言———— 4
1 mig_dma案例 ————6
1.1 案例功能———— 6
1.2 操作說明 ————6
1.3 關(guān)鍵代碼(MicroBlaze)———— 7
1.4 Vivado工程說明 ————16
1.5 IP核配置 ————18
1.5.1 MicroBlaze IP核 ————18
1.5.2 AXI DMA IP核 ————21
1.5.3 MIG 7 Series IP核 ————22
1.5.4 AXI BRAM Controller IP核 ————30
1.5.5 Block Memory Generator IP核 ————32
1.5.6 AXI Timer IP核 ————33
1.5.7 AXI GPIO IP核 ————34
2 aurora_dma案例———— 36
2.1 案例功能 ————36
2.2 操作說明———— 37
2.3 關(guān)鍵代碼(MicroBlaze)———— 38
2.4 Vivado工程說明————42
2.5 模塊/IP核配置 ————44
2.5.1 MicroBlaze IP核———— 44
2.5.2 AXI DMA IP核 ————44
2.5.3 AXI BRAM Controller IP核————46
2.5.4 Block Memory Generator IP核 ————47
2.5.5 AXI Timer IP核————48
2.5.6 Aurora 8B10B IP核———49
2.5.7 aurora_reset模塊————52
2.5.8 cdcm61002_cfg模塊———— 4
3 udp_echo案例————57
3.1 案例功能————57
3.2 操作說明————58
3.3 關(guān)鍵代碼(MicroBlaze)————61
3.4 Vivado工程說明————63
3.5 模塊/IP核配置————65
3.5.1 MicroBlaze IP核————65
3.5.2 AXI Ethernet IP核————65
3.5.3 udp_ip_stack模塊————67
3.5.4 udp_echo_server模塊————70
3.5.5 cdcm61002_cfg模塊————74
4 udp_dma案例————76
4.1 案例功能————76
4.2 操作說明————77
4.3 關(guān)鍵代碼(MicroBlaze)————78
4.4 Vivado工程說明————83
4.5 模塊/IP核配置————85
4.5.1 MicroBlaze IP核————85
4.5.2 AXI Ethernet IP核————85
4.5.3 udp_ip_stack模塊————87
4.5.4 cdcm61002_cfg模塊————91
4.5.5 AXI Timer IP核————94
4.5.6 AXI DMA IP核————95
更多幫助————97