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簡(jiǎn)介：針對(duì)嵌入式處理器對(duì)面積要求極為苛刻的特點(diǎn)，提出了一種改進(jìn)的基于Goldschmidt算法的雙精度浮點(diǎn)除法器。 改進(jìn)的除法算法的計(jì)算過程分為兩個(gè)階段，第一階段采用線性minimax多項(xiàng)式逼近算法得到一個(gè)具有15-bit精度的除數(shù)倒數(shù)的估計(jì)值。相比于minimax 二次多項(xiàng)式逼近，一次多項(xiàng)式逼近會(huì)獲得一個(gè)更小的查找表（LUT）以及在部分積累加過程中獲得更少的計(jì)算量。 在第二階段，采用基于硬件復(fù)用的方法實(shí)現(xiàn)兩次Goldschmidt迭代，使得兩次Goldschmidt迭代僅僅使用一個(gè)乘法器和一個(gè)求補(bǔ)單元。最后，該設(shè)計(jì)采用Verilog HDL進(jìn)行編碼，并基于FPGA進(jìn)行實(shí)現(xiàn)。通過與其他算法進(jìn)行比較得知，改進(jìn)的Goldschmidt除法器在性能不降低的情況下有較小的面積開銷，滿足嵌入式處理器的需求。
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