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針對正交編碼脈沖電路脈沖（ｑｕａｄｒａｔｕｒｅｅｎｃｏｄｅｒｐｕｌｓｅ，ＱＥＰ）的解碼和計數的問題，給出了ＱＥＰ解碼計數器的解決方案．本方案在復雜可編程邏輯器件（ｃｏｍｐｌｅｘｐｒｏｇｒａｍｍａｂｌｅｌｏｇｉｃｄｅｖｉｃｅ，ＣＰＬＤ）中使用ＶＨＤＬ（ＶＨＳＩＣｈａｒｄｗａｒｅｄｅ?
ｓｃｒｉｐｔｉｏｎｌａｎｇｕａｇｅ）實現語言硬件編程．整個解碼計數器設計分為脈沖邊沿檢測器，計數脈沖和計數方向發生器，上下行計數器三部分，成功的解決了由傳感器抖動引起頻繁換向時準確計數的問題．該解決方案使用Ａｌｔｅｒａ公司的ＱｕａｒｔｕｓＩＩ軟件進行設計并進行了仿真分析，最后給出了基于此技術的機床數顯表的應用實例來說明此技術的可行性和柔性．
關鍵詞：正交編碼脈沖；解碼；ＶＨＤＬ硬件語言編程；復雜可編程邏輯器件
ｓｃｒｉｐｔｉｏｎｌａｎｇｕａｇｅ）實現語言硬件編程．整個解碼計數器設計分為脈沖邊沿檢測器，計數脈沖和計數方向發生器，上下行計數器三部分，成功的解決了由傳感器抖動引起頻繁換向時準確計數的問題．該解決方案使用Ａｌｔｅｒａ公司的ＱｕａｒｔｕｓＩＩ軟件進行設計并進行了仿真分析，最后給出了基于此技術的機床數顯表的應用實例來說明此技術的可行性和柔性．
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