資料介紹
眾核處理器設(shè)計(jì)在芯片面積上受到了巨大挑戰(zhàn),如何將有限的芯片面積投入到運(yùn)算能力中,是眾核處理器體系結(jié)構(gòu)研究的熱點(diǎn)。聚焦眾核處理器的指令緩存結(jié)構(gòu)設(shè)計(jì),研究通過在多核核心之間共享一級(jí)指令緩存,以獲取指令系統(tǒng)及處理器流水線性能的提升。給出了共享指令緩存的結(jié)構(gòu)設(shè)計(jì),對(duì)該結(jié)構(gòu)進(jìn)行了節(jié)拍級(jí)精確的性能模擬,并通過RTL級(jí)代碼的綜合得到了面積開銷和時(shí)序指標(biāo)。測(cè)試結(jié)果表明,共享指令緩存可以降低11%-270/的緩存脫靶率,提升4%-70/的流水線性能。
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