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Systemviem仿真數字鎖相環試驗說明-
一.?? 試驗要求：
1. 用systemview設計并仿真一個完整的數字鎖相環電路。
2. 試驗條件設定
信號速率 10Hz
系統采樣時鐘設定：100Hz
2. 要求：
捕捉時間（即達到鎖定狀態所需時間）< 1s
同步之后的抖動每秒鐘小于1次
頻率的捕捉范圍在正負0.5Hz
相位的捕捉范圍不小于
同步后的相位偏差小于，即1/10周期的最大偏差范圍
3. 實驗報告要求
?????? 寫出設計思路和電路圖，給出簡短說明（即證明為什么你所設計的鎖相環可以進行捕獲和跟蹤）。
?????? 對試驗結果進行分析，成功和不成功的因素，為什么。
希望寫出對本次試驗的意見和改進建議。或者有好的試驗或電路的設計思路，都可以寫在實驗報告中，作為我們今后工作的參考。對于作者將考慮適當的加分。謝謝大家。
二、? ?試驗注意事項
…………
?
部分文件列表
| 文件名 | 大小 |
| Systemviem仿真數字鎖相環試驗說明.doc | 280K |
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