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標(biāo)簽 > altera
自二十年前發(fā)明世界上第一個可編程邏輯器件開始,Altera公司(阿爾特拉)(NASDAQ:ALTR)秉承了創(chuàng)新的傳統(tǒng),是世界上“可編程芯片系統(tǒng)”(SOPC)解決方案倡導(dǎo)者。Altera結(jié)合帶有軟件工具的可編程邏輯技術(shù)、知識產(chǎn)權(quán)(IP)和技術(shù)服務(wù),在世界范圍內(nèi)為14,000多個客戶提供高質(zhì)量的可編程解決方案。
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LED是發(fā)光二極管(Light Emitting diode)的英文縮寫,早期的L E D產(chǎn)品是單個的發(fā)光管,隨著數(shù)字化設(shè)備的出現(xiàn),LED數(shù)碼管和字符管...
在當(dāng)今的數(shù)字演播領(lǐng)域,視頻格式轉(zhuǎn)換具有一定的挑戰(zhàn)性,非常耗時,但又是必須的。請了解實現(xiàn)SD和HD視頻流上轉(zhuǎn)換、下轉(zhuǎn)換和交叉轉(zhuǎn)換的一種簡單方法。通過觀看這...
2018-06-22 標(biāo)簽:fpgaaltera廣播系統(tǒng) 3446 0
創(chuàng)建英特爾 Stratix 10 后配置BSDL文件的步驟
如何創(chuàng)建英特爾 Stratix 10 后配置BSDL 文件
采用Altera的CPLD器件實現(xiàn)時間統(tǒng)一系統(tǒng)的B碼源設(shè)計
隨著電子技術(shù)的發(fā)展,對遙測信號的幀結(jié)構(gòu)的可編程度、集成度的要求越來越高,用于時間統(tǒng)一系統(tǒng)的B碼源的設(shè)計也趨于高度集成化。為了適應(yīng)現(xiàn)代靶場試驗任務(wù)的要求,...
探究Altera版ARM DS-5的特點與性能應(yīng)用
ARM公司在Altera SoC 合作伙伴研討會上演講的主題:Altera版ARM DS-5
Arria10自動生成預(yù)定義的signaltap II文件
為Arria10自動生成預(yù)定義的signaltap II文件
如何創(chuàng)建 UEFI LCD與運行 LCD 應(yīng)用程序(2)
創(chuàng)建 UEFI LCD 應(yīng)用程序、運行 LCD 應(yīng)用程序(第二部分)
此次培訓(xùn)比較詳細(xì)介紹MAX 10系列,包括其特性和優(yōu)點,高層體系結(jié)構(gòu),以及密度和封裝產(chǎn)品等。此外,我們還有FPGA業(yè)界最好的設(shè)計工具和IP。它結(jié)合了這里...
您意識到對高速收發(fā)器、更高的數(shù)據(jù)速率和帶寬的需求越來越強(qiáng)烈了嗎? 您是否希望“以少勝多”呢? 請觀看這一新視頻,了解全系列收發(fā)器FPGA和ASIC怎樣滿...
介紹了解 SoC FPGA功耗問題與未來發(fā)展路線(5)
SoC FPGA系統(tǒng)成本功耗和未來發(fā)展路線
采用FPGA DIY開發(fā)板設(shè)計數(shù)字時鐘顯示
數(shù)字時鐘。數(shù)碼管顯示時、分、秒,按鍵S1、S2分別對小時進(jìn)行加、減;S3、S4分別對分進(jìn)行加10、加1;S5、S6分別對秒進(jìn)行加10、加1;S8是復(fù)位鍵。
40-nm FPGA的性能和8.5 Gbps收發(fā)器的具備功能
在這一4分鐘的視頻演示中,您將看到Altera新的40-nm FPGA展示其性能達(dá)到1.5-Gbps的LVDS以及具有優(yōu)異信號完整性的8.5-Gbps收...
可編程硬件發(fā)展路線分析:eFPGA還是FPGA SoC
eFPGA IP和FPGA SoC,誰將在未來更受歡迎呢?筆者認(rèn)為,這兩種生態(tài)都表明了SoC在摩爾定律遇到瓶頸的今天走向可配置的潮流,只是eFPGA從S...
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