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CPLD(Complex Programmable Logic Device)復(fù)雜可編程邏輯器件,是從PAL和GAL器件發(fā)展出來(lái)的器件,相對(duì)而言規(guī)模大,結(jié)構(gòu)復(fù)雜,屬于大規(guī)模集成電路范圍。是一種用戶根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。其基本設(shè)計(jì)方法是借助集成開(kāi)發(fā)軟件平臺(tái),用原理圖、硬件描述語(yǔ)言等方法,生成相應(yīng)的目標(biāo)文件,通過(guò)下載電纜(“在系統(tǒng)”編程)將代碼傳送到目標(biāo)芯片中,實(shí)現(xiàn)設(shè)計(jì)的數(shù)字系統(tǒng)。
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基于AVR和CPLD編程的高速數(shù)據(jù)采集存儲(chǔ)系統(tǒng)設(shè)計(jì)
對(duì)于一個(gè)成型的探測(cè)系統(tǒng)而言,通常都是有采集儲(chǔ)存部分的,無(wú)論是電信號(hào)、光信號(hào)、聲音信號(hào)、磁信號(hào)等在被探測(cè)器接收到后大部分都需要轉(zhuǎn)化為數(shù)字信號(hào)傳給處理器才能
FPGA/CPLD狀態(tài)機(jī)的穩(wěn)定性設(shè)計(jì)
隨著大規(guī)模和超大規(guī)模FPGA/CPLD器件的誕生和發(fā)展,以HDL(硬件描述語(yǔ)言)為工具、FPGA/CPLD器件為載體的EDA技術(shù)的應(yīng)用越來(lái)越廣泛.從...
2010-09-10 標(biāo)簽:fpgacpld狀態(tài)機(jī) 1381 0
基于 CPLD EPM570T100C5的通用直流調(diào)速模塊設(shè)
本文針對(duì)常見(jiàn)調(diào)速應(yīng)用,采用可控硅做為調(diào)速元件,采用EPM570T100C5設(shè)計(jì)和實(shí)現(xiàn)了一個(gè)通用直流調(diào)速模塊,為實(shí)現(xiàn)遠(yuǎn)距離控制內(nèi)置了RS 485通信和簡(jiǎn)單...
眾所周知,串口,是嵌入式人員最熟悉的東西,非常方便,上到PC(現(xiàn)在是USB轉(zhuǎn)串口),下到MCU51等等,都有,但是,現(xiàn)在的FPGA/CPLD等,卻獨(dú)獨(dú)沒(méi)...
基于CPLD器件設(shè)計(jì)的單穩(wěn)態(tài)電路
隨著電子技術(shù)特別是數(shù)字集成電路技術(shù)的迅猛發(fā)展,市面上出現(xiàn)了FPGA、CPLD等大規(guī)模數(shù)字集成電路,并且其工作速度和產(chǎn)品質(zhì)量不斷提高。利用大規(guī)模數(shù)字集...
1.引言 隨著大規(guī)模集成電路和單片機(jī)的迅速發(fā)展,復(fù)雜可編程邏輯器件(CPLD)具有使用靈活、可靠性高、功能強(qiáng)大的優(yōu)點(diǎn),在電子產(chǎn)品設(shè)計(jì)中得到了廣泛的應(yīng)...
今天,大多數(shù)的CPLD(復(fù)雜可編程邏輯器件)都采用可減少功耗的工作模式,但當(dāng)系統(tǒng)未使用時(shí),應(yīng)完全切斷電源以保存電池能量,從而實(shí)現(xiàn)很多設(shè)計(jì)者的終極節(jié)能目標(biāo)...
采用單片機(jī)和CPLD控制的任意波形發(fā)生器的設(shè)計(jì)
在電子工程設(shè)計(jì)與測(cè)試中,常常需要一些復(fù)雜的、具有特殊要求的信號(hào),要求其波形可任意產(chǎn)生,頻率方便可調(diào)。 結(jié)合實(shí)際需要,我們?cè)O(shè)計(jì)了一種任意波形發(fā)生器。電路設(shè)
基于CPLD的專用鍵盤(pán)接口芯片的方案設(shè)計(jì)
在單片機(jī)應(yīng)用系統(tǒng)中,存在多種形式的外部數(shù)據(jù)輸入接口界面,例如RS-232C串行通信、鍵盤(pán)輸入等[1,4] 。其中利用鍵盤(pán)接口輸入數(shù)據(jù),是實(shí)現(xiàn)現(xiàn)場(chǎng)實(shí)時(shí)調(diào)試...
CPLD設(shè)計(jì)的CCD信號(hào)發(fā)生器技術(shù)
本文設(shè)計(jì)了一種基于CPLD的可編程高精度CCD信號(hào)發(fā)生器。充分利用CPLD的可編程性.模擬出滿足系統(tǒng)要求的CD信號(hào),輸出信號(hào)頻率
CPLD設(shè)計(jì)的驅(qū)動(dòng)數(shù)碼顯示電路案例
顯示原理:??? 八段數(shù)碼顯示管如圖1.1 所示,八段數(shù)碼管每一段為一發(fā)光二極管,共有a~g 以及小數(shù)點(diǎn)dp 八個(gè)發(fā)光二極管。將八段數(shù)碼管中的每個(gè)二極管的陰極
2010-06-05 標(biāo)簽:CPLD驅(qū)動(dòng)數(shù)碼管 1990 0
基于FPGA和CPLD數(shù)字邏輯實(shí)現(xiàn)ADC技術(shù)
基于FPGA和CPLD數(shù)字邏輯實(shí)現(xiàn)ADC技術(shù) 數(shù)字系統(tǒng)的設(shè)計(jì)人員擅長(zhǎng)在其印制電路板上用FPGA和CPLD將各種處理器、存儲(chǔ)器和標(biāo)準(zhǔn)的功能元件粘合在一起來(lái)實(shí)現(xiàn)
單片機(jī)及CPLD設(shè)計(jì)的B超檢測(cè)工裝技術(shù)
單片機(jī)及CPLD設(shè)計(jì)的B超檢測(cè)工裝技術(shù) 超聲波在兩種不同組織界面處會(huì)產(chǎn)生反射、折射、散射、繞射、衰減以及聲源與接收器相對(duì)運(yùn)動(dòng)產(chǎn)生多普勒頻移
常用FPGA/CPLD四種設(shè)計(jì)技巧 FPGA/CPLD的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題,本文僅介紹一些常用的設(shè)計(jì)思想與技巧,包括乒乓球操作、串并轉(zhuǎn)換...
CPLD設(shè)計(jì)的函數(shù)信號(hào)發(fā)生器
CPLD設(shè)計(jì)的函數(shù)信號(hào)發(fā)生器 傳統(tǒng)的信號(hào)源設(shè)計(jì)常采用模擬分立元件或單片壓控函數(shù)發(fā)生器MAX038,可產(chǎn)生正弦波、方波、三角波,并通過(guò)調(diào)整外部元件改變輸...
2010-05-11 標(biāo)簽:CPLD信號(hào)發(fā)生器 2246 1
CPLD,CPLD是什么意思 CPLD是指結(jié)構(gòu)比較復(fù)雜的可編程邏輯器件,它包括下述輸出宏單元結(jié)構(gòu): (1)可編程I/O 允
2010-03-26 標(biāo)簽:CPLD 3212 0
采用CPLD的多次重觸發(fā)存儲(chǔ)測(cè)試系統(tǒng)的實(shí)現(xiàn)
采用CPLD的多次重觸發(fā)存儲(chǔ)測(cè)試系統(tǒng)的實(shí)現(xiàn) 1 引言 多次重觸發(fā)技術(shù)應(yīng)用于多種場(chǎng)合,如一個(gè)30齒的齒輪,設(shè)齒輪嚙臺(tái)系數(shù)為1.2,若測(cè)量其中1齒多次嚙合
采用CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化原理設(shè)計(jì)
采用CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化原理設(shè)計(jì) VHDL(Very High Speed Integrated Circuit Hardware...
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