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First Input First Output的縮寫，先入先出隊列，這是一種傳統的按序執行方法，先進入的指令先完成并引退，跟著才執行第二條指令。

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fifo技術

DS3112 LRCLKx低速時鐘恢復工作原理

DS3112 DS3/E3多路復用成幀器具有三種多路復用工作模式。本應用筆記描述了器件如何從三種工作模式下的高速多路復用信號中恢復低速時鐘信號。該說明解...

2023-02-07 標簽：存儲 FIFO 1018 0

基于寄存器的同步FIFO

? FIFO 是FPGA設計中最有用的模塊之一。FIFO 在模塊之間提供簡單的握手和同步機制，是設計人員將數據從一個模塊傳輸到另一個模塊的常用選擇。在...

2023-06-14 標簽：寄存器數據 fifo 1015 0

DS3112發送時鐘的時鐘速率和頻率容差

在發射端，DS3（E3）時鐘和DS1（E1）時鐘由輸入引腳派生，但DS2（E2）時鐘頻率是DS3（E3）時鐘頻率的一小部分。出于設計原因，分數將表示為整...

2023-02-22 標簽：芯片接收器 FIFO 1005 0

FIFO漫談之異步FIFO空滿信號的產生位置

格雷碼的事聊完了，后面順理成章的就是讀寫通路模塊的設計。不過在讀寫控制通路之前還要明確下另一個問題，就是空滿信號的產生位置的事情。

2024-03-19 標簽：fifo 格雷碼時鐘域 1004 0

FPGA算法技術交流問答集錦

有用過xilinx FIFO的first word fall through模式，然后write data count會少2個計數的嗎？

2023-06-12 標簽：fpga Xilinx fifo 1002 0

隊列管理電路-下篇

前文聊了隊列管理的幾種典型電路，硬件邏輯簡單，代碼實現時容易操作。鏈表也是隊列管理的常用電路，相比前文的幾種結構，會稍微復雜一些。

2023-01-21 標簽：管理電路 fifo 代碼 977 0

使用IP核創建單時鐘FIFO

FIFO，先進先出。在FPGA中使用的FIFO一般是指對數據的存儲具有先進先出的緩沖器，FIFO與普通的存儲器的不同在于它沒有讀寫地址線。舉個例子，當F...

2023-07-23 標簽：傳感器 fifo 時鐘 973 0

Linux管道和FIFO應用筆記

從上圖可以看出，可以將管道看成是一組水管，它允許數據從一個進程流向另一個進程，這也是管道名稱的由來。

2023-03-13 標簽：Linux fifo 命令 971 0

適用于低功耗信號鏈應用的功率優化技術

本文介紹用于在低功耗信號鏈應用中實現優化能效比的精密低功耗信號鏈解決方案和技術。本文將介紹功耗調節、功率循環和占空比等用于進一步降低系統功耗的技術（不僅...

2023-06-13 標簽：放大器 adc FIFO 943 0

使用SVA的幾個好處

SVA支持多時鐘域（clock domain crossing (CDC)）邏輯，例如異步FIFO。 2. SVA是一種描述語言，可讀性比較強。

2023-03-21 標簽：fifo CDC 異步 924 0

借助存儲器的工作原理及在跨時鐘域通信中的使用

為了達到可靠的數據傳輸，借助存儲器來完成跨時鐘域通信也是很常用的手段。在早期的跨時鐘域設計中，在兩個處理器間添加一個雙口RAM或者FIFO來完成相互間的...

2020-03-03 標簽：存儲器 ram fifo 908 0

如何使用硬件FIFO來減少接收中斷次數

本文給介紹如何使用帶FIFO的串口來減少接收中斷次數，通過一種自定義通訊協議格式，給出幀打包方法；之后介紹一種特殊的串口數據發送方法，可在避免使用串口發...

2023-11-06 標簽：單片機 fifo 定時器 900 0

FIFO的深度應該怎么計算

FIFO是FPGA/IC設計中經常使用到的模塊，它經常被用在兩個模塊之間進行數據的緩存，以避免數據在傳輸過程中丟失。同時FIFO也經常被用在跨時鐘域處理中。

2024-10-25 標簽：FPGA IC設計 fifo 888 0

一種高效的串口收發思路及方案

摘要：本文在探討傳統數據收發不足之后，介紹如何使用帶FIFO的串口來減少接收中斷次數，通過一種自定義通訊協議格式，給出幀打包方法；之后介紹一種特殊的串口...

2023-05-08 標簽：cpu fifo 串口 879 0

AXI接口FIFO簡介

AXI接口FIFO是從Native接口FIFO派生而來的。AXI內存映射接口提供了三種樣式：AXI4、AXI3和AXI4-Lite。除了Native接口...

2025-03-17 標簽：接口 fifo 總線 874 0

智多晶FIFO_Generator IP介紹

FIFO_Generator是智多晶設計的一款通用型FIFO IP。當前發布的FIFO_Generator IP是2.0版本，相比之前的1.1版本主要新...

2025-04-25 標簽：IP fifo 時鐘 862 0

異步FIFO相關面試問題

又到了一年一度的招聘季節，有粉絲私信問了一個問題，一個關于以前流傳出來的大廠面試的題目，個人覺得算是比較經典的題目，也是工作中經常遇到的一個問題，所以準...

2023-10-01 標簽：fifo 信號時鐘域 862 0

同步FIFO設計分析

模塊雖小但是要有新意，首先寫一個同步FIFO，這是一個爛大街的入門級項目，但是我肯定不會寫的那么簡單

2023-09-11 標簽：寄存器 sram fifo 858 0

DS3112發送時鐘的時鐘速率和頻率容差

DS3112具有六種不同的發送時鐘和六種不同的接收時鐘類型：發送DS3、DS2、DS1、E3、E2和E1時鐘，以及接收DS3、DS2、DS1、E3、E2...

2023-06-13 標簽：芯片 fifo 端口 849 0

怎樣設計一個同步FIFO？（3）

我們說這個結構之所以使得FIFO的輸出Q在讀完SRAM之后保持穩定，其實需要SRAM本身可以保持RDATA在讀操作之后的多個周期保持穩定。即SRAM本身...

2023-05-04 標簽：sram fifo 831 0

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