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Xilinx是全球領先的可編程邏輯完整解決方案的供應商。Xilinx研發、制造并銷售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統級功能的IP（Intellectual Property）核。

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xilinx技術

Xilinx可編程邏輯器件設計與開發（基礎篇）連載40：Spartan

最大化【Package Pins】，如圖10-45 所示，和按鈕配合，完成對器件引腳的排序，如圖中我們將所有VREF 引腳排在一起，選中所有VREF ...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 696 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載39：Spartan

下面通過一個簡單的實例介紹如何創建PlanAhead項目，進行I/O規劃。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 427 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載38：Spartan

PlanAhead允許導入多種不同類型的源文件，包括HDL和NGC核。在RTL編輯器中可以打開、編輯、開發RTL源文件。下面我們介紹【Sources】源...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1131 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載37：Spartan

這里介紹如何用PlanAhead進行RTL代碼開發與分析。需要說明一點，本章所用的所有實例都可以在PlanAhead的安裝目錄E:\Xilinx\11....

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 778 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載36：Spartan

PlanAhead工具是Xilinx提供的一個集成的、可視化的FPGA設計工具，它可以被應用于FPGA設計過程中的不同階段，常見的應用包括用PlanAh...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1961 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載34：Spartan

ChipScope Pro內核插入器的文件后綴名為cdc。在ISE工程中可以創建一個新的cdc程序，也可以在實現流程中激活內核插入器。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1022 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載35：Spartan

ChipScope Pro 分析工具（Analyzer tool）直接與ICON、ILA、IBA、VIO及IBERT核相連，用戶可以實時地創建或修改觸發條件。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1711 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載33：Spartan

下面通過一個簡單8位計數器的例子，了解如何在工程中添加ChipScope Pro內核生成器的各個IP核，對FPGA內部節點和邏輯進行觀測。在該實例中，我...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 881 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載32：Spartan

雙擊【Xilinx Core Generator】，打開現有的IP核工程項目或者創建一個新的IP核工程。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 768 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載31：Spartan

雙擊【Xilinx Core Generator】，打開現有的IP核工程項目或者創建一個新的IP核工程。【View by function】→【Debu...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 601 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載30：Spartan

Xilinx針對不同類型的調試IP核，提供了不同的核生成器。本節重點介紹Xilinx Core Generator Tool（Xilinx IP核生成器...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 908 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載29：Spartan

ChipScope Pro 提供了多種不同功能的調試內核，通常分成三類：邏輯調試內核、誤比特率測試核和集成總線分析核。用戶根據系統的調試要求，應用不同的...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 736 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載28：Spartan

FPGA和PCB設計人員保留一定數量FPGA引腳作為測試引腳，FPGA設計者在編寫FPGA代碼時，將需要觀察的FPGA內部信號定義為模塊的輸出，在綜合實...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 718 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載41：Spartan

設計者可以在【Clock Regions】窗口、【I/O Ports】窗口或者【Package Pins】窗口選擇一個或多個對象，或者單擊按鈕取消所有選...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 609 0

賽靈思（Xilinx）FPGA用戶約束文件的分類和語法說明

FPGA設計中的約束文件有3類：用戶設計文件（.UCF文件）、網表約束文件（.NCF文件）以及物理約束文件（.PCF文件），可以完成時序約束、管腳約束以...

2017-02-11 標簽：FPGA 賽靈思 Xilinx 1742 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載45：Spartan

本節將簡單介紹在PlanAhead工具中如何應用ChipScope核和分析工具進行邏輯調試與驗證。先通過一個向導將ChipScope核插入設計中，選擇待...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 837 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載44：Spartan

FloorPlanning 工具是PlanAhead 的一個組成部分，用它可以對FPGA 設計進行分析，首先找到設計中的時序問題或者擁塞的問題，然后再通...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 738 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載43：Spartan

在ISE 中可以進行時序分析，在PlanAhead 中同樣也可以進行時序分析。下面介紹用PlanAhead 進行時序分析的步驟。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 651 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載42：Spartan

可以將綜合后網表文件導入PlanAhead，然后在PlanAhead 中完成關鍵時鐘，以及相關聯的I/O 端口的分配。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 706 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載46：Spartan

我們知道，PicoBlaze微控制器只提供一個中斷輸入口，如果設計中需要多個中斷，可以在FPGA中用邏輯實現。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 464 0

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