如何利用電容和電感縮小PCB版面
介紹了低噪放的設計和原理圖版圖聯合仿真，但是生成的版圖比較大，占用了大量空間，接下來會用電容和電感來做匹配網絡，縮短微帶，節省空間。優化后的版圖
通過電容，電感的匹配縮減了一半的版面。原理圖版圖聯合仿真仿真模型如下
仿真結果如下
PCB版圖生成實際中生產的PCB版圖一般使用Altium Designer，PADS，Cadence allegro三種制版軟件設計。
接下來將使用Altium Designer生成PCB版圖。
原理圖如下
按照ADS的電路圖布置原理圖，同時調整一下位號，元器件數值
PCB版圖如下
2D視圖
3D視圖
編輯：hfy
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