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transient仿真的Dynamic Parameter設(shè)置技巧

通向模擬集成電路設(shè)計(jì)師之路 ? 來(lái)源:通向模擬集成電路設(shè)計(jì)師 ? 作者:通向模擬集成電路 ? 2021-07-29 17:56 ? 次閱讀
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不知道大家跑仿真的時(shí)候,會(huì)不會(huì)遇到需要?jiǎng)討B(tài)調(diào)整設(shè)置的情況?

比如一個(gè)bandgap的startup,一開(kāi)始需要仿真精度比較高,之后電路基本上穩(wěn)定之后,各個(gè)工作點(diǎn)基本上不變,可以降低仿真精度。

又比如我想測(cè)試一個(gè)電路的溫度穩(wěn)定性能,假設(shè)這個(gè)芯片在冬天的東北,忽然從溫暖的室內(nèi)拿到室外,環(huán)境溫度驟降好幾十度。

或者是輸入的信號(hào)是個(gè)動(dòng)態(tài)的幅值連續(xù)變化的情況。

一般來(lái)說(shuō),如果用一個(gè)高精度的仿真或者好幾個(gè)獨(dú)立的仿真,是足以應(yīng)付上面的需求的。不過(guò)Cadence既然已經(jīng)給了一個(gè)很不錯(cuò)的設(shè)置功能,我們何不試試看呢?

在這篇文章的例子里面,作者君用了一個(gè)ahdlLib的理想放大器,test bench如下:

4cd3ea68-edfc-11eb-a97a-12bb97331649.jpg

左邊是一個(gè)全差分輸入的設(shè)置,VDD是1.8V。右邊是ideal opamp,增益我填的是10。此時(shí)我們的輸入信號(hào)用的是V0的vsin, V4是個(gè)vdc,目前有個(gè)紅色的叉叉在上面。這個(gè)叉叉是shift加delete鍵按出來(lái)的,表示目前沒(méi)有用到這個(gè)模塊。后面需要這個(gè)模塊的時(shí)候,再按一次shift加delete鍵就可以清除掉這個(gè)叉叉了。

現(xiàn)在就讓我們來(lái)看看如何在transient仿真里面設(shè)置吧?

可以看到,最下面有個(gè)叫Dynamic Parameter的東西。打上勾之后,出現(xiàn)了Parameter和Parameter Set兩種選項(xiàng)。我們先來(lái)看看Parameter。

如果下面的Param選擇默認(rèn)的User-defined,就可以手動(dòng)輸入自己設(shè)置的變量。我這里的vamp是我在vsin里面設(shè)置的amplitude變量。輸入vamp之后,下面會(huì)出來(lái)這個(gè)可以一直添加的表格,自己填寫(xiě)時(shí)間和vamp的數(shù)值,就可以了。

好了,我隨便寫(xiě)了幾個(gè)變量值,讓我們跑一下transient吧!

仿真結(jié)果就是這樣的。顏色較淺的兩條線是差分輸入信號(hào),藍(lán)色的線是ideal opamp的輸出。可以看到,和我前面的設(shè)置相對(duì)應(yīng),在2us,4us,6us的時(shí)候,輸入信號(hào)發(fā)生了變化,因此輸出也隨之發(fā)生了變化。這個(gè)仿真結(jié)果說(shuō)明了上面的設(shè)置是可行的。

同樣的,除了改變我們自己設(shè)置的參數(shù)變量值,我們還可以改變其他一些仿真設(shè)置。

這張圖里的errpreset就是仿真精度的設(shè)置。如同我剛剛舉的bandgap例子,大家可以在startup開(kāi)始工作的一段時(shí)間內(nèi),使用高精度conservative,在后面的時(shí)間里使用moderate或者liberal。當(dāng)需要跑大量的PVT或者M(jìn)C時(shí),這樣的設(shè)置方法相比于一直使用conservative的高精度,應(yīng)該是可以加快仿真速度的。有興趣的同學(xué)可以試試看。

除此之外,還有set的設(shè)置。

如上圖,如果選擇了Parameter Set,就不單單是前面的一個(gè)變量了。你可以加上各種各樣的變量組合。比如我在2us的時(shí)候,設(shè)置了vamp,設(shè)置了溫度變量temp為-25,還準(zhǔn)備加上仿真精度errpreset。后面的嘗試,就交給各位讀者朋友了!

前面我講到了我的test bench里面那個(gè)紅色的叉叉。現(xiàn)在我們換一個(gè)信號(hào)源:

4d72cf02-edfc-11eb-a97a-12bb97331649.png

我還是用shift加上delete,刪掉了vsin,但是重新采用了vdc。dynamic parameter的設(shè)置還是跟前文一樣,新的電路仿真結(jié)果如圖:

4d85c116-edfc-11eb-a97a-12bb97331649.png

其實(shí)這個(gè)結(jié)果比vsin還要清晰一點(diǎn)。同樣也是在2u,4u,6u,的時(shí)候,輸入信號(hào)發(fā)生了變化,因此輸出也隨之發(fā)生了變化。

好了,這點(diǎn)transient仿真的小技巧就講到這里了。有興趣的讀者們可以試試看啦!

編輯:jq

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原文標(biāo)題:Cadence 仿真小技巧——transient仿真的Dynamic Parameter設(shè)置

文章出處:【微信號(hào):analogIC_gossip,微信公眾號(hào):通向模擬集成電路設(shè)計(jì)師之路】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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