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UG470文檔 page144 描述

OpenFPGA ? 來源:OpenFPGA ? 作者:OpenFPGA ? 2022-07-15 09:05 ? 次閱讀

fpga 上電時,默認是從 flash 的 0x00 地址開始讀數(shù)據(jù)。如 UG470 文檔 page144 描述

708e5ce0-03d6-11ed-ba43-dac502259ad0.png

fpga 會從 0 開始讀,地址不斷自增,直到讀取到有效的同步字 sync word(0xAA995566),才認為接下來的內(nèi)容是一個有效的 bin 文件內(nèi)容的開始。讀到有效 sync word 后不會再繼續(xù)讀搜尋其他的 bin 文件。如 UG470 文檔 page81 描述:

70a0b386-03d6-11ed-ba43-dac502259ad0.png

幾種情況

只有一個 bit 文件,使用如下命令將該 bit 文件寫出轉(zhuǎn)換為 mcs 文件,并燒入 spi flash 中。

write_cfgmem-formatmcs-interfacespix4-size8-loadbit{up
0x400000./soc_top.bit}-filesoc_top_0x400000.mcs-force

該 bit 文件在 flash 中存放的起始地址是 0x400000 ,上電 fpga 能正常啟動,因為前部分的地址 0x000000-0x400000 之間都是無效數(shù)據(jù), fpga 從 0x000000 地址開始讀,沒有有效的 sync word ,讀地址不斷增加,直到 0x400000 地址才會讀到同步字,然后就能正常的從 0x400000 開始配置。

有兩個 bit 文件,使用該命令轉(zhuǎn)換為一個 mcs 文件

write_cfgmem-formatmcs-interfacespix4-size8-loadbit{up0x000000./design1.bit
up0x400000./design2.bit}-filemixed.mcs-force

第一個 bit 文件放在 0x000000 地址,第二個放在 0x400000 地址,燒寫 flash ,上電后 fpga 從 deign1.bit
啟動,因為第一個 bit 在前面, fpga 上電后從 0x000000 地址開始讀,會先讀到 deign1.bit ,然后成功地從deign1.bit 初始化。

若把 mcs 文件中關于 deign1.bit 的 FDRI data 的內(nèi)容手動改為其他值,使得配置的時候會出現(xiàn) CRC 校驗錯誤, deign2.bit 相關的內(nèi)容不變,燒寫進flash,上電, FPGA 無法正常配置數(shù)據(jù),既不會從deign1.bit啟動,也不能從deign2.bit 啟動,這是因為第一個bit在前面, fpga 上電后從 0x000000 地址開始讀,會先讀到 deign1.bit ,然后從 deign1.bit 開始初始化,但是會發(fā)生CRC錯誤,然后又fallback 回 0 地址讀,依然是讀到 design1.bit 的數(shù)據(jù),還是 CRC 錯誤,最后發(fā)生配置失敗。

若只把 mcs 文件中關于 deign1.bit 的 sync word 的內(nèi)容手動改為其他值,比如 0xAA997866 ,deign2.bit 相關的內(nèi)容不變,燒寫進 flash 上電, FPGA 成功從 deign2.bit 啟動。這是因為第一個 bit 在前面, fpga 上電后從0x000000 地址開始讀,讀到 deign1.bit 的 sync word 為 0xAA997866 時,發(fā)現(xiàn)不是有效的 sync word ,不會判斷接下來的內(nèi)容是屬于一個有效的配置文件,于是繼續(xù)自增地址往上讀,直到讀到 0x400000 地址后面,成功讀到 design2.bit 的 sync word ,發(fā)現(xiàn)有效,然后從 deign2.bit 開始初始化。這樣就跳過了前面 deign1.bit 的內(nèi)容。

bitstream 約束

對bit流進行壓縮

set_propertyBITSTREAM.GENERAL.COMPRESSTRUE[current_design]

打開看門狗功能

set_propertyBITSTREAM.CONFIG.CONFIGFALLBACKENABLE[current_design]

如果加載 Update_Image 配置文件失敗后,沒有返回加載 Golden_Image ,則會根據(jù)指定的時間啟動看門狗,強制返回加載 Golden_Image 。

生成 bit 文件的頭部添加 IPROG 命令和設置 WBSTAR 的命令

set_propertyBITSTREAM.CONFIG.NEXT_CONFIG_ADDR0x0400000[current_design]

配置時執(zhí)行到 IPROG 命令后,會直接跳轉(zhuǎn)到指定的地址中繼續(xù)執(zhí)行配置。可用于 Golden_Image 中設置為跳轉(zhuǎn)到 Update_Image 啟動。其實加不加這個約束,生成的bit流中的頭部,都會有 IPROG 和設置 WBSTAR 的相關命令的占位空間,只是不加該約束時, IPROG 的位置會由 000000 替代, NOP 指令,只是空的占位符;而寫 WBSTAR 寄存器的指令依然存在,但是寫 WBSTAR 的值卻是 0 。

原文標題:Xilinx FPGA 從spi flash啟動配置數(shù)據(jù)時的地址問題

文章出處:【微信公眾號:OpenFPGA】歡迎添加關注!文章轉(zhuǎn)載請注明出處。

審核編輯:彭靜

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