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Cadence新支持臺積電的N16RF設計參考流程和制程設計套件

Cadence楷登 ? 來源:Cadence楷登 ? 作者:Cadence楷登 ? 2022-11-03 14:18 ? 次閱讀

Cadence 攜手臺積電,賦能 N6 毫米波射頻設計,加速推進移動、5G 及汽車應用創新

中國上海,2022 年 11 月 3 日 —— 楷登電子(美國 Cadence 公司,NASDAQ:CDNS)今日宣布,Cadence 射頻集成電路解決方案支持臺積電的 N16RF 設計參考流程和制程設計套件(PDK),助力加速推進新一代移動、5G 及汽車應用。通過 Cadence 與臺積電的持續合作,雙方的共同客戶可以使用支持臺積電最新 N16RF 毫米波半導體技術的 Cadence 解決方案來進行設計。

Cadence 射頻集成電路解決方案支持 Cadence 智能系統設計(Intelligent System Design)戰略,助力實現系統級芯片(SoC)的卓越設計。

完整的射頻設計參考流程包括無源器件建模、模塊級優化、敏感版圖布線網電磁寄生參數簽核、帶有定制無源器件及自發熱效應的 EM-IR 分析。該參考流程提供了針對臺積電 N16RF 毫米波工藝技術進行優化的幾款產品,包括 Cadence Virtuoso Schematic Editor、Virtuoso ADE Product Suite 和集成的 Spectre X Simulator 及射頻選項。

此外,該流程還具有大容量電磁(EM)模型生成功能,使用 Cadence EMX 3D Planar Solver 將 S 參數模型無縫反標注到原理圖中,并使用 Voltus-Fi Custom Power Integrity Solution 進行自發熱 EM-IR 分析,實現 EM 和 RCX 模型的自動管理,獲得精確的射頻結果。借助該流程,用戶可以有效地管理工藝角仿真,提高設計可靠性。

EMX Planar 3D Solver 和 Quantus Parasitic Extraction 集成到 Virtuoso 平臺,實現耦合效應的分層提取,有力地保障了全設計電磁寄生參數簽核。Cadence 射頻集成電路全流程提供了一種有效的方法,利用高度整合的統一設計環境,幫助工程師實現設計目標—性能、功耗效率和可靠性。

“通過與 Cadence 的持續合作,客戶能夠利用 Cadence 認證的流程和我們先進的 N16 毫米波工藝技術提高生產力,”臺積電設計基礎設施管理部門負責人 Dan Kochpatcharin 表示,“借助這個新的參考流程,打造新一代移動、汽車、5G、醫療和航空航天設計的設計者可以更加輕松地快速采用我們的技術。我們已經看到有客戶利用我們的技術來推動創新?!?/p>

“通過與臺積電的緊密合作,利用其 N16 毫米波工藝技術以及我們全面的射頻和射頻集成電路流程,客戶可以獲得更先進的技術和能力,打造極具競爭力的設計,”Cadence 高級副總裁兼定制 IC與 PCB 事業部總經理 Tom Beckley 表示,“Cadence 力求為我們的共同客戶提供更好的流程,我們不斷聽取客戶反饋,了解他們的實際設計需求。這些反饋使我們能夠相應地優化流程,這樣客戶就能專注于設計而不是集成?!?/p>

審核編輯:彭靜
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原文標題:Cadence 推出新的臺積電 N16 毫米波參考流程,加快射頻設計

文章出處:【微信號:gh_fca7f1c2678a,微信公眾號:Cadence楷登】歡迎添加關注!文章轉載請注明出處。

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