總線信號電平
由于總線可以提供可變的電源電壓，所以所有的信號電平都與電源電壓有關(guān)。
為了滿足JEDEC規(guī)范JESD8-1A和JESD8-7的要求，對于允許電壓范圍的任何Vdd，卡的輸入和輸出電壓應(yīng)上文中所示的電壓規(guī)定范圍內(nèi):
BUS Timing (Default）
0 Hz表示時鐘停止。給出的最小頻率范圍是用于需要持續(xù)時鐘的情況。
Bus Timing (High-Speed Mode)
為了滿足嚴(yán)格的時序要求，主機(jī)只能驅(qū)動一張卡。
審核編輯 黃宇
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