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一文詳解Vivado時序約束

FPGA設計論壇 ? 來源:CSDN技術社區 ? 2025-03-24 09:44 ? 次閱讀
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一、概覽

e3ef9d9a-0561-11f0-9310-92fbcf53809c.png

二、創建約束

Vivado的時序約束是保存在xdc文件中,添加或創建設計的工程源文件后,需要創建xdc文件設置時序約束。時序約束文件可以直接創建或添加已存在的約束文件,創建約束文件有兩種方式:Constraints Wizard和Edit Timing Constraints,在綜合后或實現后都可以進行創建。

2.1 Constraints Wizard

Constraints Wizard流程下將會以引導式的方式幫助用戶設置約束,以綜合后的設置為例,在Flow Navigator窗口中,進入Synthesis->Open Synthesized->Constraints Wizard

e401298e-0561-11f0-9310-92fbcf53809c.png

點擊Constraints Wizard,彈出彈框提示無約束文件,選擇Define Target

e41f5b0c-0561-11f0-9310-92fbcf53809c.png

選擇Create File創建約束文件

e43047aa-0561-11f0-9310-92fbcf53809c.png

File name設置約束文件名字,File location設置約束文件保存路徑,默認即可

e455e348-0561-11f0-9310-92fbcf53809c.png

勾選Target下的方框后,右下角的OK 高亮,點擊OK。

e45d6dc0-0561-11f0-9310-92fbcf53809c.png

在Source窗口中查看創建的約束文件,包含了timing_set.xdc文件,說明創建成功

e4813c82-0561-11f0-9310-92fbcf53809c.png

2.2 Edit Timing Constraints

Edit Timing Constraints和Constraints Wizard處于相同的標題下

e48bd6b0-0561-11f0-9310-92fbcf53809c.png

點擊Edit Timing Constraints,進入設置界面,左側中顯示可設置的約束類型,默認是選擇Create Clock,點擊紅框中的“+”號,進入添加界面

e4a51ea4-0561-11f0-9310-92fbcf53809c.png

輸入Clock name,設置Source object和時鐘周期相關值,點擊OK,

e4b32e54-0561-11f0-9310-92fbcf53809c.png

點擊保存圖標后按ctrl+s,彈出保存框,點擊OK

e4d70324-0561-11f0-9310-92fbcf53809c.png

設置保存的約束文件名后,點擊OK

e4e1e24e-0561-11f0-9310-92fbcf53809c.png

在All Constraints中將出現剛剛設置的約束

e4fca1a6-0561-11f0-9310-92fbcf53809c.png

2.3 Constraints目錄下創建

Source窗口下進入Constraints中,鼠標點擊右鍵彈出彈窗,進入Add sources中可以創建或添加約束文件

e50cffd8-0561-11f0-9310-92fbcf53809c.png

點擊Next

e52d597c-0561-11f0-9310-92fbcf53809c.png

選擇Create File

e53b62c4-0561-11f0-9310-92fbcf53809c.png

輸入約束文件名,點擊OK保存成功

e56038b0-0561-11f0-9310-92fbcf53809c.png

2.4 Sources窗口“+”創建

在Source窗口下,有一個“+”圖標,點擊該圖標

e56cd700-0561-11f0-9310-92fbcf53809c.png

進入Add Sources窗口,剩余操作和2.3 Constraints目錄下創建相同

e5934052-0561-11f0-9310-92fbcf53809c.png

2.5 菜單欄File中創建

在菜單欄File中的列表中,選擇“Add Sources”

e5ae4938-0561-11f0-9310-92fbcf53809c.png

進入Add Sources界面

e5d5dde0-0561-11f0-9310-92fbcf53809c.png

選擇Create File,后續的操作和2.3節相同

e5f47dae-0561-11f0-9310-92fbcf53809c.png

三、設置約束

3.1 約束類型

vivado支持的約束有5大類,具體見下圖

e603f2f2-0561-11f0-9310-92fbcf53809c.png

在timing constraints中顯示了可設置的約束,左側點擊要設置的約束類型,右側序號2位置處自動顯示該類約束,此時再點擊3,自動進入創建約束的窗口中。

e631dd7a-0561-11f0-9310-92fbcf53809c.png

進入set system jitter窗口

e63e2706-0561-11f0-9310-92fbcf53809c.png

3.2 約束命令

各種約束的使用格式可參見Language Templates,在Language templates的模板templates中,XDC中Timing Constraints選擇需要設置的約束,右側Preview自動顯示約束的格式

e65fe224-0561-11f0-9310-92fbcf53809c.png

原文鏈接:https://blog.csdn.net/zyp626/article/details/132866676

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原文標題:Vivado之時序約束操作大全

文章出處:【微信號:gh_9d70b445f494,微信公眾號:FPGA設計論壇】歡迎添加關注!文章轉載請注明出處。

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