四、電子電路故障檢查的一般方法

對于新設(shè)計組裝的電路來說，常見的故障原因有：

（1）實驗電路與設(shè)計的原理圖不符；元件使用不當(dāng)或損壞；

（2）設(shè)計的電路本身就存在某些嚴(yán)重缺點，不能滿足技術(shù)要求，連線發(fā)生短路和開路；

（3）焊點虛焊，接插件接觸不良，可變電阻器等接觸不良；

（4）電源電壓不合要求，性能差；

（5）儀器作用不當(dāng)；

（6）接地處理不當(dāng)；

（7）相互干擾引起的故障等。

檢查故障的一般方法有：直接觀察法、靜態(tài)檢查法、信號尋跡法、對比法、部件替換法旁路法、短路法、斷路法、暴露法等，下面主要介紹以下幾種：

1. 直接觀察法和信號檢查法：與前面介紹的調(diào)試前的直觀檢查和靜態(tài)檢查相似，只是更有目標(biāo)針對性。

2. 信號尋跡法：在輸入端直接輸入一定幅值、頻率的信號，用示波器由前級到后級逐級觀察波形及幅值，如哪一級異常，則故障就在該級；對于各種復(fù)雜的電路，也可將各單元電路前后級斷開，分別在各單元輸入端加入適當(dāng)信號，檢查輸出端的輸出是否滿足設(shè)計要求。

3. 對比法：將存在問題的電路參數(shù)與工作狀態(tài)和相同的正常電路中的參數(shù)（或理論分析和仿真分析的電流、電壓、波形等參數(shù)）進行比對，判斷故障點，找出原因。

4. 部件替換法：用同型號的好器件替換可能存在故障的部件。

5. 加速暴露法：有時故障不明顯，或時有時無，或要較長時間才能出現(xiàn)，可采用加速暴露法，如敲擊元件或電路板檢查接觸不良、虛焊等，用加熱的方法檢查熱穩(wěn)定性差等等。

五、電子電路設(shè)計性實驗報告 設(shè)計性實驗報告主要包括以下幾點：

1. 課題名稱

2. 內(nèi)容摘要

3. 設(shè)計內(nèi)容及要求

4. 比較和選擇的設(shè)計方案

5. 單元電路設(shè)計、參數(shù)計算和器件選擇

6. 畫出完整的電路圖。并說明電路的工作原理

7. 組裝調(diào)試的內(nèi)容，如使用的主要儀器和儀表、調(diào)試電路的方法和技巧、測試的數(shù)據(jù)和波形并與計算結(jié)果進行比較分析、調(diào)試中出現(xiàn)的故障、原因及排除方法

8. 總結(jié)設(shè)計電路的特點和方案的優(yōu)缺點，指出課題的核心及實用價值，提出改進意見和展望

9. 列出元器件清單

10. 列出參考文獻(xiàn)?

11. 收獲、體會

實際撰寫時可根據(jù)具有情況作適當(dāng)調(diào)整。

六、電子電路干擾的抑制

1. 干擾源

電子電路工作時，往往在有用信號之外還存在一些令人頭痛的干擾源，有的產(chǎn)生于電子電路內(nèi)部，有的產(chǎn)生于外部。外部的干擾主要有：高頻電器產(chǎn)生的高頻干擾、電源產(chǎn)生的工頻干擾、無線電波的干擾；內(nèi)部的干擾主要有：交流聲、不同信號之間的互相感應(yīng)、調(diào)制，寄生振蕩、熱噪聲、因阻抗不匹配產(chǎn)生的波形畸變或振蕩。

2. 降低內(nèi)部干擾的措施

（1） 元器件布局： 元件在印刷線路板上排列的位置要充分考慮抗電磁干擾問題，原則之一是各部件之間的引線要盡量短。在布局上，要把模擬信號部分，高速數(shù)字電路部分，噪聲源部分（如繼電器，大電流開關(guān)等）這三部分合理地分開，使相互間的信號耦合為最小。

（2） 電源線設(shè)計：根據(jù)印制線路板電流的大小，盡量加租電源線寬度，減少環(huán)路電阻。 同時、使電源線、地線的走向和數(shù)據(jù)傳遞的方向一致，這樣有助于增強抗噪聲能力。

（3） 地線設(shè)計：在電子設(shè)備中，接地是控制干擾的重要方法。如能將接地和屏蔽正確結(jié)合起來使用，可解決大部分干擾問題（詳細(xì)方法見下節(jié)接地）。

（4） 退藕電容配置線路板設(shè)計的常規(guī)做法之一是在線路板的各個關(guān)鍵部位配置適當(dāng)?shù)耐伺弘娙荨Ｍ伺弘娙莸囊话闩渲迷瓌t是：

電源輸入端跨接10 ~100uf的電解電容器。如有可能，接100uF以上的更好。

原則上每個集成電路芯片都應(yīng)布置一個0.01pF的瓷片電容，如遇印制板空隙不夠，可每4~8個芯片布置一個1 ~ 10pF的但電容。

對于抗噪能力弱、關(guān)斷時電源變化大的器件，如 RAM、ROM存儲器件，應(yīng)在芯片 的電源線和地線之間直接接入退藕電容。

電容引線不能太長，尤其是高頻旁路電容不能有引線。 此外，還應(yīng)注意以下兩點：

在印制板中有接觸器、繼電器、 按鈕等元件時。操作它們時均會產(chǎn)生較大火花放電，必須采用附圖所示的 RC 電路 來吸收放電電流。一般 R 取 1 ~ 2K，C取2.2 ~ 47UF.

CMOS的輸入阻抗很高，且易受感應(yīng)，因此在使用時對不用端要接地或接正電源。

3. 降低外部干擾的措施有：

（1） 遠(yuǎn)離干擾源或進行屏蔽處理；

（2） 運用濾波器降低外界干擾。 七、 接地

接地分安全接地、工作接地，這里所談的是工作接地，設(shè)計接地點就是要盡可能減少各支路電流之間的相互耦合干擾，主要方法有：單點接地、串聯(lián)接地、平面接地。在電子設(shè)備中，接地是控制干擾的重要方法。如能將接地和屏蔽正確結(jié)合起來使用，可解決大部分干擾問題。電子設(shè)備中地線結(jié)構(gòu)大致有系統(tǒng)地、機殼地（屏蔽地）、數(shù)字地（邏輯地）和模擬地等。在地線設(shè)計中應(yīng)注意以下幾點：

1. 正確選擇單點接地與多點接地

在低頻電路中，信號的工作頻率小于1MHz，它的布線和器件間的電感影響較小，而接地電路形成的環(huán)流對干擾影響較大，因而應(yīng)采用一點接地。當(dāng)信號工作頻率大于10MHz時，地線阻抗變得很大，此時應(yīng)盡量降低地線阻抗，應(yīng)采用就近多點接地。高頻電路宜采用多點串聯(lián)接地，地線應(yīng)短而租，高頻元件周圍盡量用柵格狀大面積地箔。當(dāng)工作頻率在1~10MHz時，如果采用一點接地，其地線長度不應(yīng)超過波長的1/20，否則應(yīng)采用多點接地法。

2.將數(shù)字電路與模擬電路分開

電路板上既有高速邏輯電路，又有線性電路，應(yīng)使它們盡量分開，而兩者的地線不要相混，分別與電源端地線相連。要盡量加大線性電路的接地面積。

3. 盡量加粗接地線

若接地線很細(xì)，接地電位則隨電流的變化而變化，致使電子設(shè)備的定時信號電平不穩(wěn)，抗噪聲性能變壞。因此應(yīng)將接地線盡量加粗。

4. 將接地線構(gòu)成閉環(huán)路

設(shè)計只由數(shù)字電路組成的印制電路板的地線系統(tǒng)時，將接地線做成閉環(huán)路可以明顯的提高抗噪聲能力。其原因在于：印制電路板上有很多集成電路元件，尤其遇有耗電多的元件時，因受接地線粗細(xì)的限制，會在地結(jié)上產(chǎn)生較大的電位差，引起抗噪聲能力下降，若將接地結(jié)構(gòu)成環(huán)路，則會縮小電位差值，提高電子設(shè)備的抗噪聲能力。