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針對CMOS器件的閂鎖現(xiàn)象，結(jié)合三種實(shí)際的應(yīng)用電路分析了電路系統(tǒng)中閂鎖的幾種典型表現(xiàn)形式及其解決的方法，討論了電路設(shè)計(jì)時(shí)避免閂鎖的一般性原則。這些分析方法及解決措施源于實(shí)際的系統(tǒng)設(shè)計(jì)，并經(jīng)過了大量的驗(yàn)證，簡單有效，對于應(yīng)用系統(tǒng)的抗閂鎖設(shè)計(jì)具有普遍的參考價(jià)值。
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