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衡量FPGA設計的兩個重要指標是吞吐率和延遲。
吞吐率：指系統每一個時鐘周期內能夠處理的數據數量，為了獲得更高的吞吐率就需要減少組合邏輯延遲，在組合邏輯中間插入寄存器，也就是流水線設計。
延遲：指數據從輸入系統到輸出系統總共需要的時間，為了獲得更短的延遲，可以減少組合邏輯延遲，或者刪減路徑上的寄存器，第二種方法顯然不利于系統獲得更好的性能。
時序優化的幾種方法
這里說的優化是讓FPGA設計獲得更高的工作頻率，也就是通常說的性能和吞吐率。
1. 插入寄存器（pipeline）
這種方式會增加設計的時滯（clock latency）。插入了幾個寄存器，結果輸出就會延長幾個周期，在不違反設計規格（對clock latency有要求）以及功能沒有影響的時滯情況之下可以這么做。舉例說明，如果下面一個FIR濾波器的設計沒能滿足時序要求。
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