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Buck DC-DC 的PCB layout1、C~IN~、 C~BYPASS~、 D1的放置2、電感的放置3、輸出電容的放置4、反饋網(wǎng)絡(luò)布線5、總結(jié)如果大家還有什么想法，評(píng)論區(qū)見(jiàn)：）歡迎轉(zhuǎn)載，轉(zhuǎn)載注明出處！在我剛開(kāi)始學(xué)習(xí)畫(huà)PCB的時(shí)候，對(duì)于電源這一部分的布局不是很在意，只要輸出電壓正確，走線載流夠就可以了，當(dāng)時(shí)布局布線都是以盡量緊湊為原則。后來(lái)在PLL和PA的測(cè)試過(guò)程中，發(fā)現(xiàn)電源網(wǎng)絡(luò)的噪聲會(huì)直接影響輸出信號(hào)的相位噪聲（PN）和輸出頻譜的雜散值。一個(gè)好的電源網(wǎng)絡(luò)設(shè)計(jì)甚至可以將雜散值降低十幾個(gè)dB。當(dāng)然，
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