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標簽 > 去耦電容
去耦電容是電路中裝設在元件的電源端的電容,此電容可以提供較穩定的電源,同時也可以降低元件耦合到電源端的噪聲,間接可以減少其他元件受此元件噪聲的影響。
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這一點可通過思考并聯連接容值相同的電容時,到諧振點的容性特性、取決于ESR(等效串聯電阻)的諧振點阻抗、諧振點以后的ESL(等效串聯電感)影響的感性特性來理解。
背板輸入信號緩沖器應用下拉電阻和串阻。背板輸入信號緩沖器下拉電阻取10K,串阻取100歐姆。背板輸入信號緩沖器輸入先下拉再經過串阻,設計上會具有更大的靈...
印制線應遠離干擾源且不能切割磁力線;避免平行走線,雙面板可以交叉通過,單面板可以通過“飛線”跨過;避免成環,防止產生環形天線效應;時鐘信號布線應與地線靠...
諸如放大器和轉換器等模擬集成電路具有至少兩個或兩個以上電源引腳。對于單電源器件,其中一個引腳通常連接到地。如ADC和DAC等混合信號器件可以具有模擬和數...
旁路電容(Bypass Capacitor)和去耦電容(Decoupling Capacitor)這兩個概念在電路中是常見的,但是真正理解起來并不容易。
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