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CPLD(Complex Programmable Logic Device)復(fù)雜可編程邏輯器件,是從PAL和GAL器件發(fā)展出來(lái)的器件,相對(duì)而言規(guī)模大,結(jié)構(gòu)復(fù)雜,屬于大規(guī)模集成電路范圍。是一種用戶根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。其基本設(shè)計(jì)方法是借助集成開(kāi)發(fā)軟件平臺(tái),用原理圖、硬件描述語(yǔ)言等方法,生成相應(yīng)的目標(biāo)文件,通過(guò)下載電纜(“在系統(tǒng)”編程)將代碼傳送到目標(biāo)芯片中,實(shí)現(xiàn)設(shè)計(jì)的數(shù)字系統(tǒng)。
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隨著嵌入式微處理器技術(shù)的進(jìn)步,32位ARM處理器系統(tǒng)擁有很高的運(yùn)算速度和很強(qiáng)的信號(hào)處理能力,可以作為視覺(jué)系統(tǒng)的處理器,代替PC機(jī)來(lái)實(shí)現(xiàn)簡(jiǎn)單的視覺(jué)處理算法...
2011-08-19 標(biāo)簽:ARMCPLD嵌入式視覺(jué) 1183 0
基于CoolRunner CPLD的MP3應(yīng)用開(kāi)發(fā)板的設(shè)計(jì)
本文介紹了基于CoolRunner CPLD的MP3應(yīng)用開(kāi)發(fā)板的設(shè)計(jì)流程,驗(yàn)證了利用現(xiàn)有IP Core設(shè)計(jì)的可行性和高效性。在設(shè)計(jì)過(guò)程中,硬件(實(shí)驗(yàn)評(píng)估...
2011-08-18 標(biāo)簽:CPLDMP3開(kāi)發(fā)板 1714 0
基于Verilog簡(jiǎn)易UART的FPGA/CPLD實(shí)現(xiàn)
在xo640上實(shí)現(xiàn)一個(gè)簡(jiǎn)單的Uart,能夠解析串口數(shù)據(jù),并在寄存器中存儲(chǔ),用FIFO實(shí)現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過(guò)開(kāi)發(fā)板上的串口經(jīng)CPLD訪問(wèn)各種數(shù)據(jù)...
CPLD系統(tǒng)上的信號(hào)發(fā)生器設(shè)計(jì)
文中采用Quartus II開(kāi)發(fā)平臺(tái),基于可編程邏輯器件CPLD設(shè)計(jì)出多波形信號(hào)發(fā)生器,可輸出頻率、幅度可調(diào)的三角波、正弦波和方波。任意波形模塊可由用戶...
2011-07-04 標(biāo)簽:CPLD信號(hào)發(fā)生器 2102 0
采用低成本的 CPLD 器件替代了價(jià)格昂貴,且難以購(gòu)買的 GPIB 控制芯片, 成功的實(shí)現(xiàn)了具有自主知識(shí)產(chǎn)權(quán)的 IP CORE,并且所有核心模塊完全采用...
采用CPLD作為核心構(gòu)成的校正系統(tǒng)具有功耗低、抗干擾能力強(qiáng)、功能實(shí)現(xiàn)方便和擴(kuò)展靈活等優(yōu)點(diǎn),能夠有效地適用于多種圖像傳感器的校正
賽靈思Verilog(FPGA/CPLD)設(shè)計(jì)小技巧
以下是一個(gè)在設(shè)計(jì)中常犯的錯(cuò)誤列表這些錯(cuò)誤常使得你的設(shè)計(jì)不可靠或速度較慢為了提高你的設(shè)計(jì)性能和提高速度的可靠性你必須確定你的設(shè)計(jì)通過(guò)所有的這些檢查。
基于CPLD/FPGA的CMI編碼設(shè)計(jì)與實(shí)現(xiàn)
CMI碼是傳號(hào)反轉(zhuǎn)碼的簡(jiǎn)稱,它是一種應(yīng)用于PCM四次群和光纖傳輸系統(tǒng)中的常用線路碼型,具有碼變換設(shè)備簡(jiǎn)單、有較多的電平躍變,含有豐富的定時(shí)信息,便于時(shí)鐘...
基于CPLD的壓電生物傳感器檢測(cè)電路的設(shè)計(jì)
本文介紹了一種基于復(fù)雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測(cè)電路.該檢測(cè)電路以高性能CPLD(MAX7128)為核心,實(shí)現(xiàn)了對(duì)壓電生物傳感器10...
基于CPLD技術(shù)的A/D轉(zhuǎn)換組合研究
1引言 A/D轉(zhuǎn)換組合是雷達(dá)目標(biāo)諸元數(shù)據(jù)轉(zhuǎn)換、傳輸?shù)暮诵牟考?一旦出現(xiàn)故障,目標(biāo)信號(hào)將無(wú)法傳送到信息處理中心進(jìn)行處理,從而導(dǎo)致雷達(dá)主要功能失效。...
2010-11-29 標(biāo)簽:CPLD 759 0
基于CPLD的DSP人機(jī)接口模塊設(shè)計(jì)
CPLD(Complex programmable Logic Device,復(fù)雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎(chǔ)上發(fā)展而來(lái)的,具有多種...
基于CPLD的片內(nèi)環(huán)形振蕩器的設(shè)計(jì)方案
本文介紹一種通用的基于CPLD的片內(nèi)振蕩器設(shè)計(jì)方法,它基于環(huán)形振蕩器
2010-11-08 標(biāo)簽:CPLD環(huán)形振蕩器 3381 0
本文討論的四種常用FPGA/CPLD設(shè)計(jì)思想與技巧:乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化,都是FPGA/CPLD邏輯設(shè)計(jì)的內(nèi)在規(guī)律的
O 引言 靶場(chǎng)測(cè)試領(lǐng)域中槍械的擊發(fā)是一個(gè)重要的環(huán)節(jié)。傳統(tǒng)的槍械擊發(fā)采用人工方式,即射擊人員聽(tīng)到射擊指令后手工扣動(dòng)槍械扳機(jī)進(jìn)行擊發(fā),這種方式存在
2010-10-27 標(biāo)簽:CPLD 751 0
利用CPLD實(shí)現(xiàn)數(shù)字濾波及抗干擾
1 濾波和抗干擾概述單片機(jī)應(yīng)用系統(tǒng)的輸入信號(hào)常含有種種噪聲和干擾,它們來(lái)自被測(cè)信號(hào)源、傳感器、外界干擾源等。為了提高測(cè)量和控制精度,必須消除信號(hào)中的噪聲
基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng)
CPLD是復(fù)雜的PLD,專指那些集成規(guī)模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路、輸出宏單元組成,具有門電路集成度高、可配置...
FPGA與CPLD的辨別和分類主要是根據(jù)其結(jié)構(gòu)特點(diǎn)和工作原理。通常的分類方法是: 將以乘積項(xiàng)結(jié)構(gòu)方式構(gòu)成邏輯行為的器件稱為
基于CPLD和VHDL的電梯控制系統(tǒng)設(shè)計(jì)
1 引言 隨著社會(huì)的發(fā)展。使用電梯越來(lái)越普遍,已從原來(lái)只在商業(yè)大廈、賓館過(guò)渡到在辦公室、居民樓等多種建筑中,并且對(duì)電梯功能的要求也不斷提高,其
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