eda工具

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EDA工具軟件可大致可分為芯片設(shè)計(jì)輔助軟件、可編程芯片輔助設(shè)計(jì)軟件、系統(tǒng)設(shè)計(jì)輔助軟件等三類。進(jìn)入我國(guó)并具有廣泛影響的EDA軟件是系統(tǒng)設(shè)計(jì)軟件輔助類和可編程芯片輔助設(shè)計(jì)軟件：Protel、PSPICE、multiSIM10（原EWB的最新版本）、OrCAD、PCAD、LSIIogic、MicroSim，ISE，modelsim等等。

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eda工具技術(shù)

一篇文章了解S參數(shù)的相關(guān)應(yīng)用背景

在EDA仿真結(jié)果中，S參數(shù)是一個(gè)經(jīng)常被提及的結(jié)果，關(guān)于S參數(shù)詳細(xì)內(nèi)容，其實(shí)不管是網(wǎng)上還是教科書都有較規(guī)范的介紹，但是大多數(shù)并不適用沒(méi)有EDA背景的讀者。

2023-06-21 標(biāo)簽：EDA工具仿真器信號(hào)完整性 2955 0

NCSIM、VCS和QuestaSim后仿真如何屏蔽冗余的違例信息呢？

在進(jìn)行數(shù)字電路后仿真時(shí)，經(jīng)常會(huì)遇到很多時(shí)序?yàn)槔ǔ＿@些違例都是由網(wǎng)表中大量的時(shí)序檢查報(bào)出的。

2024-01-03 標(biāo)簽：EDA工具 soc 數(shù)字電路 2943 0

pcb疊層設(shè)計(jì)原則如何設(shè)計(jì)PCB疊層？

在設(shè)計(jì)2層PCB時(shí)，實(shí)際上不需要考慮PCB在工廠的結(jié)構(gòu)問(wèn)題。但是，當(dāng)電路板上的層數(shù)為四層或更多時(shí)，PCB的堆疊是一個(gè)重要因素。

2023-07-19 標(biāo)簽：PCB板 EDA工具 PCB設(shè)計(jì) 2780 0

干擾耦合途徑抑制干擾噪聲的方法

外部干擾源產(chǎn)生的噪聲影晌到檢測(cè)系統(tǒng)的正常工作，是經(jīng)由某種傳播途徑被耦合到了檢測(cè)系統(tǒng)之中。

2023-10-12 標(biāo)簽：放大器 EDA工具寄生電容 2731 0

soc芯片工程師需要必備哪些技能呢？

芯片設(shè)計(jì)知識(shí)：了解芯片設(shè)計(jì)的基本原理和流程，包括RTL設(shè)計(jì)、綜合、布局布線、驗(yàn)證等方面的知識(shí)。

2023-08-14 標(biāo)簽：EDA工具芯片設(shè)計(jì)SoC芯片 2725 0

在元件封裝選擇元件時(shí)需要考慮哪些問(wèn)題

確保設(shè)計(jì)具有足夠的旁路電容和地平面。在使用集成電路時(shí)，確保在靠近電源端到地（最好是地平面）的位置使用合適的去耦電容。電容的合適容量取決于具體應(yīng)用、電容技...

2019-04-20 標(biāo)簽：pcb eda工具元件封裝 2704 1

可以用captable代替qrcTechfile文件嗎

隨著先進(jìn)工藝已經(jīng)進(jìn)入到3nm階段，EDA工具對(duì)Delay計(jì)算的準(zhǔn)確度變得十分具有挑戰(zhàn)性，Cadence設(shè)置如下表參數(shù)，通過(guò)setDesignMode -...

2022-10-10 標(biāo)簽：EDA工具 2675 0

如何設(shè)計(jì)出一個(gè)高質(zhì)量的高速PCB板

總的來(lái)說(shuō)，設(shè)計(jì)好一個(gè)高質(zhì)量的高速PCB板，應(yīng)該從信號(hào)完整性(SI---Signal Integrity)和電源完整性(PI---Power Integr...

2019-05-22 標(biāo)簽：pcb板 eda工具 pcb設(shè)計(jì) 2659 0

coverpoint是什么意思

“oc”是Coverpoint的名稱。‘oc’覆蓋了2比特變量‘offset’。由于沒(méi)有指定收集哪些bin，EDA仿真工具會(huì)默認(rèn)為我們創(chuàng)建4個(gè)bin(a...

2022-11-14 標(biāo)簽：EDA工具 BIN文件 2649 0

什么是DFT友好的功能ECO呢？

DFT是確保芯片在制造過(guò)程中具有可測(cè)試性的一種技術(shù)。DFT友好的ECO是指在進(jìn)行ECO時(shí)，不會(huì)破壞芯片的DFT功能或降低DFT覆蓋率的設(shè)計(jì)方法。

2023-03-06 標(biāo)簽：寄存器 EDA工具 DFT 2435 0

ProteuS在ARM開(kāi)發(fā)中的應(yīng)用解析

Proteus軟件是英國(guó)Labcenter electronics公司的EDA工具軟件，是一個(gè)電子設(shè)計(jì)的教學(xué)平臺(tái)、實(shí)驗(yàn)平臺(tái)和創(chuàng)新平臺(tái)，涵蓋了電工電子實(shí)驗(yàn)...

2019-11-19 標(biāo)簽：arm EDA工具 Proteus 2335 0

Net Delay在整個(gè)路徑延時(shí)的占比是什么情況呢？

繞線延時(shí)（Net Delay）是怎么計(jì)算出來(lái)的呢？Net Delay在整個(gè)路徑延時(shí)（Path Delay）的占比又是什么情況呢？針對(duì)關(guān)鍵路徑，工具會(huì)如何...

2023-06-27 標(biāo)簽：EDA工具 SoC設(shè)計(jì)DFM 2329 0

聊一聊FPGA中的IP都是怎么區(qū)分的呢？

現(xiàn)今的FPGA設(shè)計(jì)規(guī)模越來(lái)越龐大，功能越來(lái)越復(fù)雜，因此FPGA設(shè)計(jì)的每個(gè)部分都從頭開(kāi)始著手是不切實(shí)際的。

2023-05-22 標(biāo)簽：FPGA設(shè)計(jì)寄存器 EDA工具 2283 0

芯片設(shè)計(jì)小經(jīng)驗(yàn)—異步電路跨時(shí)鐘域小結(jié)

關(guān)于異步電路，是面試?yán)锉粏?wèn)的最多的部分，網(wǎng)上也有很多很多的總結(jié)文章。這里有兩個(gè)原因。第一，這是一種比較成熟的通用設(shè)計(jì)手段，電路結(jié)構(gòu)也比較經(jīng)典。第二是因?yàn)?..

2023-05-18 標(biāo)簽：fpga EDA工具異步電路 2248 0

ignore_bins和default兩者之間有些什么細(xì)微差別呢？

在SystemVerilog中，經(jīng)常會(huì)需要將一些值或者翻轉(zhuǎn)行為從覆蓋率中排除掉，ignore_bins是經(jīng)常被用到的一種方式，其實(shí)除了ignore_bins之外

2023-07-14 標(biāo)簽：EDA工具仿真器 Verilog語(yǔ)言 2232 0

解析SDF的Header Section信息與Cell Entries信息

SDF文件是在VCS/NC-Verilog后仿真運(yùn)行時(shí)將STD/IO/Macro門級(jí)verilog中specify的延遲信息替換為QRC/Star-RC...

2023-05-06 標(biāo)簽：EDA工具脈沖信號(hào)低電平 2211 0

如何從DC直流損耗仿真（IR drop）換去熱仿真？

這期我們介紹PCB熱仿真，重點(diǎn)是確定熱源和PCB簡(jiǎn)化。PCB上的熱源有三種：**元件功率散熱，****DC** **直流損耗熱轉(zhuǎn)換，** **AC** ...

2023-06-16 標(biāo)簽：EDA工具熱仿真求解器 2195 0

std::randomize隨機(jī)結(jié)果不符合預(yù)期？

在近期的一個(gè)testcase調(diào)試中，遇到一個(gè)std::randomize隨機(jī)結(jié)果不符合預(yù)期的現(xiàn)象。

2023-10-29 標(biāo)簽：EDA工具仿真器 STD 2183 0

verilog語(yǔ)言的可綜合性和仿真特性

綜合就是將HDL語(yǔ)言轉(zhuǎn)化成與，非，或門等等基本邏輯單元組成的門級(jí)連接。因此，可綜合語(yǔ)句就是能夠通過(guò)EDA工具自動(dòng)轉(zhuǎn)化成硬件邏輯的語(yǔ)句。

2023-06-28 標(biāo)簽：編碼器 EDA工具 RTL 2163 0

芯片設(shè)計(jì)中跨時(shí)鐘域CDC的那些事

這里我們先復(fù)習(xí)一下同步電路和異步電路的概念。在現(xiàn)代SoC設(shè)計(jì)中，絕大多數(shù)的電路都是同步電路。

2023-06-20 標(biāo)簽：EDA工具 SoC設(shè)計(jì)鎖存器 2156 0

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Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

+關(guān)注

FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

+關(guān)注

pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
PCB封裝庫(kù)

PCB封裝庫(kù)

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語(yǔ)音交互

語(yǔ)音交互

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
驅(qū)動(dòng)電流

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AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
FPGA教程

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Protel DXP

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紅外觸摸屏

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