eda工具

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EDA工具軟件可大致可分為芯片設(shè)計(jì)輔助軟件、可編程芯片輔助設(shè)計(jì)軟件、系統(tǒng)設(shè)計(jì)輔助軟件等三類。進(jìn)入我國并具有廣泛影響的EDA軟件是系統(tǒng)設(shè)計(jì)軟件輔助類和可編程芯片輔助設(shè)計(jì)軟件：Protel、PSPICE、multiSIM10（原EWB的最新版本）、OrCAD、PCAD、LSIIogic、MicroSim，ISE，modelsim等等。

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eda工具技術(shù)

模擬IC設(shè)計(jì)的這些坑你都踩過嗎？

模擬IC是負(fù)責(zé)生產(chǎn)、放大和處理各類模擬信號的電路，工程師通過模擬電路把模擬信號放大縮小后，再全部記錄下來，是連續(xù)的信號；而數(shù)字IC則是通過0和1兩個代號...

2023-03-06 標(biāo)簽：模擬IC IC設(shè)計(jì)EDA工具 2451 0

在Verilog中實(shí)現(xiàn)Moore型和Mealy型狀態(tài)機(jī)的方法簡析

編寫能夠被綜合工具識別的狀態(tài)機(jī)，首先需要理解狀態(tài)機(jī)的基本概念和分類。狀態(tài)機(jī)(FSM)是表示有限個狀態(tài)以及在這些狀態(tài)之間轉(zhuǎn)換的邏輯結(jié)構(gòu)。

2024-05-01 標(biāo)簽：EDA工具 Verilog 狀態(tài)機(jī) 2444 0

verilog語言的可綜合性和仿真特性

綜合就是將HDL語言轉(zhuǎn)化成與，非，或門等等基本邏輯單元組成的門級連接。因此，可綜合語句就是能夠通過EDA工具自動轉(zhuǎn)化成硬件邏輯的語句。

2023-06-28 標(biāo)簽：編碼器 EDA工具 RTL 2417 0

芯片設(shè)計(jì)中跨時鐘域CDC的那些事

這里我們先復(fù)習(xí)一下同步電路和異步電路的概念。在現(xiàn)代SoC設(shè)計(jì)中，絕大多數(shù)的電路都是同步電路。

2023-06-20 標(biāo)簽：EDA工具 SoC設(shè)計(jì)鎖存器 2413 0

邏輯綜合在整個IC設(shè)計(jì)流程RTL2GDS中的位置

根據(jù)摩爾定律的發(fā)展，晶體管的Poly的最小柵極長度已經(jīng)到達(dá)了1nm甚至更小，集成電路的規(guī)模越來越大，集成度越來越高。

2023-03-27 標(biāo)簽：IC設(shè)計(jì)EDA工具 HDL 2347 0

淺析形式驗(yàn)證的分類、發(fā)展、適用場景

Formal Verification：利用數(shù)學(xué)分析的方法，通過算法引擎建立模型，對待測設(shè)計(jì)的狀態(tài)空間進(jìn)行窮盡分析的驗(yàn)證。

2023-08-25 標(biāo)簽：EDA工具 RTL SVA 2337 0

如何在FLOEFD中查看風(fēng)扇工作點(diǎn)？

在產(chǎn)品散熱設(shè)計(jì)時需要查看風(fēng)扇的工作點(diǎn)是否合理，F(xiàn)LOEFD在計(jì)算完成之后，可以直接查看風(fēng)扇工作狀態(tài)點(diǎn)。

2023-03-20 標(biāo)簽：EDA工具半導(dǎo)體器件 CAE 2325 0

數(shù)字實(shí)現(xiàn)過程中的慣性延遲和傳輸延遲

一般用來指定模塊內(nèi)部信號通過邏輯單元或者線網(wǎng)耗費(fèi)的時間。

2023-11-07 標(biāo)簽：EDA工具仿真器傳輸線 2325 0

典型的DRC案例介紹

在進(jìn)行DFT Logic的設(shè)計(jì)和插入之前，DFT工程師會先使用EDA工具對原Design執(zhí)行DRC（Design Rule Checking），即設(shè)計(jì)規(guī)則檢查。

2023-09-15 標(biāo)簽：寄存器 EDA工具 DRC 2306 0

簡述進(jìn)行?IC設(shè)計(jì)的方法和設(shè)計(jì)流程

IC設(shè)計(jì)是一門非常復(fù)雜的科學(xué)，在IC生產(chǎn)流程中，IC芯片主要由專業(yè)IC設(shè)計(jì)公司進(jìn)行規(guī)劃、設(shè)計(jì)，如聯(lián)發(fā)科、高通、Intel等國際知名大廠，都自行設(shè)計(jì)各自專...

2023-07-19 標(biāo)簽：CMOS IC設(shè)計(jì)EDA工具 2183 0

淺析嘉立創(chuàng)EDA PDF文件的輸出教程

在PCB生產(chǎn)調(diào)試期間，為了方便查看文件或者查詢相關(guān)元件信息，會把PCB設(shè)計(jì)文件轉(zhuǎn)換成PDF文件。

2023-05-10 標(biāo)簽：EDA工具 PCB設(shè)計(jì) 2146 0

低功耗設(shè)計(jì)基礎(chǔ)：Clock Gating

大多數(shù)低功耗設(shè)計(jì)手法在嚴(yán)格意義上說并不是由后端控制的，Clock Gating也不例外。

2023-06-27 標(biāo)簽：寄存器 EDA工具 RTL 2145 0

Simcenter FLOEFD EDA Bridge模塊分析

Simcenter?FLOEFD?軟件EDA Bridge 模塊提供一種方法，可以將詳細(xì)的印刷電路板（PCB）導(dǎo)入到您所使用的MCAD（機(jī)械計(jì)算機(jī)輔助設(shè)...

2023-07-25 標(biāo)簽：PCB板 EDA工具熱電阻 2120 0

SystemVerilog里的regions以及events的調(diào)度

本文講一下SystemVerilog的time slot里的regions以及events的調(diào)度。SystemVerilog語言是根據(jù)離散事件執(zhí)行模型定...

2023-07-12 標(biāo)簽：EDA工具仿真器 Verilog語言 2091 0

仿真測試1：半加器

做任何模塊前，要確定輸入輸出端口有哪些，有一個整體的概念；方便以后模塊調(diào)用；

2023-10-10 標(biāo)簽：EDA工具仿真器 RTL 2049 0

EDA仿真驗(yàn)證環(huán)境中的激勵、檢查和覆蓋率

下圖是一個典型的EDA仿真驗(yàn)證環(huán)境，其中主要的組件就是激勵生成、檢查和覆蓋率收集。

2023-04-15 標(biāo)簽：EDA工具 EDA仿真技術(shù)DUT 2030 0

串?dāng)_，窗口以及CRPR對Delta Delay的處理方式

一切煩惱的根源來源于執(zhí)念，串?dāng)_和噪聲則來源于電容兩端電壓差不能突變。

2023-06-28 標(biāo)簽：EDA工具電容電壓 1987 0

在questasim里如何設(shè)置和查看種子值呢？

在systemverilog代碼運(yùn)行中，EDA工具會先給1個隨機(jī)種子值(seed)，所有代碼里的隨機(jī)數(shù)都是根據(jù)這個初始種子衍生出來的。

2023-05-29 標(biāo)簽：EDA工具 Verilog TCL 1965 0

Vivado在FPGA設(shè)計(jì)中的優(yōu)勢

Xilinx的新一代設(shè)計(jì)套件Vivado相比上一代產(chǎn)品ISE，在運(yùn)行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進(jìn)。但是對初學(xué)者來說，新的約束語言X...

2022-09-19 標(biāo)簽：fpga FPGA設(shè)計(jì)EDA工具 1920 0

如何采用EDA工具實(shí)現(xiàn)EWIS系統(tǒng)的一致性

FAR 25.1711描述了EWIS組件必須帶有的認(rèn)證和信息類型，包括組件的功能、冗余考慮事項(xiàng)、隔離要求和唯一性。在飛機(jī)中，每個組件都有且只有一個相應(yīng)的...

2019-01-25 標(biāo)簽：eda工具 cots 1892 0

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Protues

Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語音交互

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PCB封裝庫

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
VHDL代碼

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時鐘源

時鐘源

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時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
驅(qū)動電流

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實(shí)現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
Protel DXP

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紅外觸摸屏

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