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fpga設(shè)計(jì)

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計(jì)技術(shù)

時(shí)鐘是電路的實(shí)際控制者？

時(shí)鐘是整個(gè)FPGA設(shè)計(jì)里面無法回避的事物，不能認(rèn)識(shí)時(shí)鐘也就沒法做FPGA設(shè)計(jì)。

2023-06-28 標(biāo)簽：FPGA設(shè)計(jì)計(jì)數(shù)器 RTL 524 0

教你如何利用verilog輕松實(shí)現(xiàn)高分辨率DDS

上圖就是DDS的的FPGA實(shí)現(xiàn)框圖，完整的DDS還應(yīng)該在外面有DAC和低通濾波器的，然而很多時(shí)候我們是不需要這兩個(gè)的，因?yàn)樯蠄D的DDS輸出的信號(hào)就在數(shù)字...

2023-06-28 標(biāo)簽：FPGA設(shè)計(jì)ROM 低通濾波器 3033 0

FPGA設(shè)計(jì)-時(shí)序約束實(shí)例分析

現(xiàn)有一塊ADC連接到FPGA上，需要在FPGA上實(shí)現(xiàn)高速數(shù)據(jù)的讀取，那么第一步自然就是完成可靠的硬件連線

2023-06-28 標(biāo)簽：FPGA設(shè)計(jì)寄存器 TTL電路 992 0

一個(gè)亞穩(wěn)態(tài)設(shè)計(jì)案例分析

CPLD規(guī)模雖小，其原理和設(shè)計(jì)方法和FPGA確是一樣的。輕視在CPLD上的投入，就有可能存在設(shè)計(jì)隱患，導(dǎo)致客戶使用產(chǎn)品時(shí)出現(xiàn)故障，從而給公司帶來不可挽回...

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)寄存器觸發(fā)器 539 0

FPGA實(shí)現(xiàn)OFDM（2）-OFDM通信的整體框圖

介紹除了OFDM外，一個(gè)完整通信鏈路中所需的其他環(huán)節(jié)，給出發(fā)射機(jī)鏈路和接收機(jī)鏈路的整體框圖，最后結(jié)合802.11a介紹相關(guān)技術(shù)指標(biāo)。

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)移位寄存器 OFDM技術(shù) 2315 0

FPGA實(shí)現(xiàn)OFDM（1）-OFDM的原理是什么？

fromwiki:調(diào)制是將傳送資料對(duì)應(yīng)于載波變化的動(dòng)作，可以是載波的相位、頻率、幅度、或是其組合。

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)編碼器 DFT 2548 0

離散小波變換的FPGA實(shí)現(xiàn)(二)

眾所周知,小波變換的雙正交基就來自與小波函數(shù)和尺度函數(shù),而他們通過scale和平移來得到的小波函數(shù)族和尺度函數(shù)族表示了不同小波(尺度)函數(shù)的分辨率

2023-06-27 標(biāo)簽：濾波器 FPGA設(shè)計(jì)小波變換 1690 0

從處理單bit跨時(shí)鐘域信號(hào)同步問題來入手

在數(shù)字電路中，跨時(shí)鐘域處理是個(gè)很龐大的問題，因此將會(huì)作為一個(gè)專題來陸續(xù)分享。今天先來從處理單bit跨時(shí)鐘域信號(hào)同步問題來入手。

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)IC設(shè)計(jì)仿真器 2112 0

在RTL編碼書寫中如何考慮時(shí)延與布線的問題呢？

分if-else,case 的各種情況分開討論,主要目的是將分支支路中晚到的信號(hào)放到離輸出最近的一級(jí)中

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)比較器 RTL 1189 0

異步電路的跨時(shí)鐘域處理

異步電路不能根據(jù)時(shí)鐘是否同源來界定，時(shí)鐘之間沒有確定的相位關(guān)系是唯一準(zhǔn)則。

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)芯片設(shè)計(jì)異步電路 1290 0

AXI實(shí)戰(zhàn)(一)-搭建簡(jiǎn)單仿真環(huán)境

在驗(yàn)證中有三個(gè)核心組件:Driver(驅(qū)動(dòng)器/激勵(lì))，Monitor（監(jiān)測(cè)器），Checker（比較器）。在這里實(shí)際上我們只需要了解其中最核心的Driv...

2023-06-27 標(biāo)簽：驅(qū)動(dòng)器 FPGA設(shè)計(jì)比較器 2625 0

VVAS調(diào)用HLS生成硬件加速器的主要流程介紹

我們以smartcam的預(yù)處理作為例子。xf_pp_pipeline的作用是將輸入圖像的格式從NV12轉(zhuǎn)換為BGR，再進(jìn)行減均值和歸一化操作。

2023-06-26 標(biāo)簽：FPGA設(shè)計(jì)計(jì)算機(jī)視覺 opencv 1432 0

嘮一嘮解決FPGA約束中時(shí)序不收斂的問題

FPGA時(shí)序不收斂，會(huì)出現(xiàn)很多隨機(jī)性問題，上板測(cè)試大概率各種跑飛，而且不好調(diào)試定位原因，所以在上板測(cè)試前，先優(yōu)化時(shí)序，再上板。

2023-06-26 標(biāo)簽：FPGA設(shè)計(jì)寄存器 RAM 3224 0

FPGA設(shè)計(jì)衍生時(shí)鐘約束和時(shí)鐘分組約束設(shè)置

FPGA設(shè)計(jì)中，時(shí)序約束對(duì)于電路性能和可靠性非常重要。

2023-06-26 標(biāo)簽：FPGA設(shè)計(jì)時(shí)序約束 Vivado 2797 0

在Vivado中如何寫入FPGA設(shè)計(jì)主時(shí)鐘約束？

在FPGA設(shè)計(jì)中，時(shí)序約束的設(shè)置對(duì)于電路性能和可靠性都至關(guān)重要。

2023-06-26 標(biāo)簽：收發(fā)器 FPGA設(shè)計(jì)時(shí)序約束 2761 0

FPGA時(shí)序約束理論篇之時(shí)序路徑與時(shí)序模型

典型的時(shí)序路徑有4類，如下圖所示，這4類路徑可分為片間路徑（標(biāo)記①和標(biāo)記③)和片內(nèi)路徑（標(biāo)記②和標(biāo)記④）。

2023-06-26 標(biāo)簽：FPGA設(shè)計(jì)寄存器觸發(fā)器 870 0

FPGA設(shè)計(jì)-時(shí)序約束（理論篇）

STA（Static Timing Analysis，即靜態(tài)時(shí)序分析）在實(shí)際FPGA設(shè)計(jì)過程中的重要性是不言而喻的

2023-06-26 標(biāo)簽：FPGA設(shè)計(jì)寄存器觸發(fā)器 886 0

握手機(jī)制、通道依賴性及AXI-Lite握手實(shí)例

AXI4：高性能內(nèi)存映射需求（如讀寫DDR、使用BRAM控制器讀寫B(tài)RAM等），為了區(qū)別，有時(shí)候也叫這個(gè)為 AXI4-Full；

2023-06-25 標(biāo)簽：FPGA設(shè)計(jì)接收機(jī)BRAM 1813 0

電平設(shè)計(jì)基礎(chǔ)：電平匹配設(shè)計(jì)

單端邏輯電平的匹配是我們平時(shí)在硬件設(shè)計(jì)中最經(jīng)常碰到的，我們?cè)凇禩TL&CMOS電平》章節(jié)中已經(jīng)對(duì)TTL和COMS電平的匹配設(shè)計(jì)做了一些分析，一般...

2023-06-25 標(biāo)簽：二極管 FPGA設(shè)計(jì)MOS管 3870 0

PCIe例程理解之用戶邏輯接收模塊仿真分析

下圖給出了反相器相位插指器的基本結(jié)構(gòu)。結(jié)構(gòu)很簡(jiǎn)單，兩個(gè)反相器陣列輸入分別接兩個(gè)時(shí)鐘，輸出直接短接在一起，數(shù)字信號(hào)控制反相器陣列選通的數(shù)目。

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)寄存器存儲(chǔ)器 1434 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語音交互

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PCB封裝庫

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AD09

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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