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FPGA（Field－Programmable Gate Array），即現場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發展的產物。
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FIFO IP核報Memory Collision Error on RAMB36E1解決方案
以前很少用到仿真，這次在仿真的過程中，遇到了某個警告，于是轉過頭又去研究了FIFO中的Safety Circuit的作用。
首先需要把FIR最基本的結構實現，也就是每個FIR抽頭的數據與其抽頭系數相乘這個操作。由頂層文件對這個基本模塊進行多次調用。
由于以太網測試使用的開發板是淘寶購買的某款開發板，開發人員在電路設計時沒有考慮到將以太網芯片的接收時鐘、發送時鐘通過FPGA的專用時鐘管腳接入到到全局時鐘網絡
FPGA內部表示正負數，小數的規則。兩者相比之下，定點數實現簡單，表達更為直觀，所以在很多時候FPGA通常使用定點數表示小數。
在芯片功能驗證中，仿真波形一直是調試的重要手段。通過觀測分析波形，工程師可以推斷代碼是否正常運行，電路的功能是否正確，設計是否滿足預期。
定點數硬件實現簡單，但表示的范圍有限，且部分的小數運算IP核只支持浮點數運算，因此這里還需要提到浮點數的相關內容。
根據《通信原理》一書可知，m序列是最長線性反饋移位寄存器的簡稱，它產生的偽隨機序列的周期與其反饋移存器級數有關;
OSERDES實現并串轉換，只需要管發送并不需要管接收到的數據如何，所以它的操作相對于ISERDES來說簡單；
高速信號傳輸過程中，并行傳輸因為線路同步難，抗干擾性差等缺點逐漸被串行技術取代；通過提高傳輸速率的方法，串行傳輸也可以實現很高的傳輸速度。
在高速信號采集的過程中，經常會因為電路設計或者其他原因，原本設計好對應的data_clk與data經過線路傳輸之后在接收端時序上不能很好的對應，這可能會...
最近調試芯片遇到一個選擇題，需要決定數據接口的接口標準，是選用LVDS差分接口還是CMOS單端接口。
濾波器是一種用來減少，消除干擾的電器部件，有對特定頻率的頻點或該頻點以外的頻率信號進行有效濾除，從而實現消除干擾、獲取特定頻率信號的功能。
這種方法是通過將模擬濾波器頻率特性H(s)反拉氏變換為h(t)，再將h(t)等間隔抽樣成h(n)后，對h(n)取Z變換求得H(z)，即得到了數字濾波器的...
開放式無線接入網（Open Radio Access Network，簡稱 O-RAN）是一種無線接入網 (RAN)。
因為CNN的特有計算模式，通用處理器對于CNN實現效率并不高，不能滿足性能要求。 因此，近來已經提出了基于FPGA，GPU甚至ASIC設計的各種加速器來...
FIFO 是FPGA設計中最有用的模塊之一。FIFO 在模塊之間提供簡單的握手和同步機制，是設計人員將數據從一個模塊傳輸到另一個模塊的常用選擇。
在FPGA設計中，時序約束對于電路性能和可靠性非常重要。在上一篇的文章中，已經詳細介紹了FPGA時序約束的主時鐘約束。
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