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FPGA（Field－Programmable Gate Array），即現場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發展的產物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現的，既解決了定制電路的不足，又克服了原有可編程器件門電路數有限的缺點。

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6系列FPGA中使用塊RAM的心得(4)

然后調用sinplify，對其進行綜合，結果很不順利。首先是synplify報不支持器件，才發現synplify 9.6.2是2008年的產品，比Spa...

2017-02-11 標簽：FPGA RAM 2748 0

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2017-02-11 標簽：FPGA 5340 0

ASIC設計轉FPGA時需要注意的幾點

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2017-02-11 標簽：FPGA asic 3149 0

FPGA開發基礎知識問答

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2017-02-11 標簽：FPGA 973 0

FPGA開發要掌握的六大基礎知識（3）

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2017-02-11 標簽：FPGA 賽靈思 Xilinx 1580 0

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2017-02-11 標簽：FPGA register latch 1618 0

FPGA基礎知識問答500問連載（三）

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2017-02-11 標簽：FPGA 邏輯電平 936 0

FPGA基礎知識問答500問連載（二）

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2017-02-11 標簽：FPGA 1549 0

影響FPGA設計周期生產力的最大因素是什么？

提高FPGA設計生產力的工具、技巧和方法，9影響FPGA設計周期生產力的最大因素是什么？

2017-02-11 標簽：FPGA FPGA設計時序 747 0

FPGA學習的四大誤區

FPGA為什么是可以編程的？恐怕很多菜鳥不知道，他們也不想知道。因為他們覺得這是無關緊要的。他們潛意識的認為可編程嘛，肯定就是像寫軟件一樣啦。軟件編程的...

2017-02-11 標簽：FPGA 可編程邏輯 694 0

正在進行軟件無線電FPGA重新設計

認知無線電(CR)是一種智能的無線電通信系統，它能夠感知周圍的電磁環境、無線信道特征以及用戶需求，并通過推理和對以往經驗的學習，自適應地調整其內部配置，...

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2017-02-11 標簽：FPGA 1088 0

如何使用腳本對Xilinx FPGA編程

最近在做一個GUI的項目，想試著用FPGA實現一個簡單的GUI。硬件基本模塊和整個硬件系統已經完成設計，但是軟件程序上還處在調試階段，由于程序比較大，F...

2017-02-11 標簽：FPGA Xilinx GUI 2082 0

FPGA全局時鐘和第二全局時鐘資源的使用方法

目前,大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計,對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求,一...

2017-02-11 標簽：FPGA 賽靈思全局時鐘 5206 0

Verilog設計中的一些避免犯錯的小技巧

這是一個在設計中常犯的錯誤列表，這些錯誤常使得你的設計不可靠或速度較慢，為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過所有的這些檢查。

2017-02-11 標簽：FPGA Verilog 727 0

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2017-02-11 標簽：FPGA 賽靈思 7537 0

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以下是一個在設計中常犯的錯誤列表這些錯誤常使得你的設計不可靠或速度較慢為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過所有的這些檢查。

2017-02-11 標簽：FPGA 賽靈思 Verilog 1305 0

基于verilog的FPGA編程經驗總結

用了半個多月的ISE，幾乎全是自學起來的，碰到了很多很多讓人DT好久的小問題，百度也百不到，后來還是都解決了，為了盡量方便以后的剛學ISE的童鞋不再因為...

2017-02-11 標簽：FPGA verilog 1584 0

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2017-02-11 標簽：FPGA Tilera GPU 1175 0

說說賽靈思（Xilinx ）的FPGA 高速串行收發器

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2017-02-11 標簽：FPGA 賽靈思 Xilinx 6477 0

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