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標簽 > ip核
IP就是知識產權核或知識產權模塊的意思,在EDA技術開發中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產業的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。
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電子發燒友網核心提示: DRAM控制器藏在您的系統核心芯片系統(SoC)中,可能有兩個,甚至是四個。有一些精心制作的邏輯小模塊,用于連接SoC內部和外部...
基于Avalon總線SHT11溫濕度傳感器自定義IP核的開發流程
本文介紹了基于Avalon總線SHT11溫濕度傳感器自定義IP核的開發流程,利用有限狀態機設計了驅動硬件邏輯,并且基于NiosII嵌入式處理器構建了一個...
基于Altera浮點IP核的浮點矩陣相乘運算的實現和改進設計
嵌入式計算作為新一代計算系統的高效運行方式,應用于多個高性能領域,如陣列信號處理、核武器模擬、計算流體動力學等。在這些科學計算中,需要大量的浮點矩陣運算...
在FPGA中利用CORDIC算法IP核實現三角函數關系的轉換
在FPGA硬件實現CORDIC的邏輯其實是很簡單的,就是設置好輸入輸出的位寬,然后建立好對應的精度表,通過旋轉加得到運算結果。
ZedBoard學習手記(二) 開發自定義AXI總線外設IP核
想要發揮ZYNQ芯片的特長,讓整個系統協同工作起來,就需要將PS與PL兩部分結合在一起,在Cortex-A9核和FPGA邏輯資源之間建立通信的通道,這條...
您可能已經習慣了芯片系統(SoC)的multicore處理器這一概念,而現實卻總是在不斷變化。8月份舉行的Hot Chips大會研討中,已經清楚的表明m...
對于IP核輸出數據的解析最好的工具就是其自帶的仿真文件,里面既將接收的數據進行了解析,又將發送給IP核的數據進行了封裝,這對于了解數據結構和協議是十分有...
FPGA之軟核演練篇:內置IP核之Interval Timer的應用實戰講解
軟核演練篇包含了哪些內容:該篇以什么是軟核、什么是Qsys、如何構建一個Qsys系統為切入點,在該基礎上進一步介紹了Nios II處理器的體系結構、Qs...
Quartus II支持Altera的IP核,包含了LPM/MegaFunction宏功能模塊庫,使用戶可以充分利用成熟的模塊,簡化了設計的復雜性、加快...
2019-12-23 標簽:alteraip核quartus ii 4002 0
本文介紹一個FPGA 開源項目:Micro Blaze最小系統。MicroBlaze是Xilinx提供的一個軟核IP,該軟核是由FPGA片內邏輯資源組成...
2023-09-01 標簽:fpgaXilinxMicroBlaze 3881 0
賽靈思軟件通過調整編譯參數以及運行并行編譯來優化FPGA時序性能
萬幸的是,當今FPGA工具(比如Xilinx的 Vivado)都有很多開關和設置選項來幫助時序收斂。InTime的方法,就是通過調整FPGA工具的編譯過...
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