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IP就是知識產權核或知識產權模塊的意思,在EDA技術開發中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產業的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。
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數字芯片設計驗證經驗分享(第三部分):將ASIC IP核移植到FPGA上——如何確保性能與時序以完成充滿挑戰的
本篇文章是SmartDV數字芯片設計經驗分享系列文章的第三篇,將繼續分享第五、第六主題,包括確保在FPGA上實現所需的性能和時鐘兩個方面的考量因素。
RAM-Based Shift Register Xilinx IP核的使用
一般來講,如果要實現移位寄存器的話,通常都是寫RTL用reg來構造,比如1bit變量移位一個時鐘周期就用1個reg,也就是一個寄存器FF資源,而移位16...
鋯石FPGA A4_Nano開發板視頻:VGA外設的IP核定制
IP核有三種不同的存在形式:HDL語言形式,網表形式、版圖形式。分別對應我們常說的三類IP內核:軟核、固核和硬核。這種分類主要依據產品交付的方式,而這三...
本文介紹了LCD的通用驅動電路IP核設計,采用自頂向下的設計方法將其劃分為幾個主要模塊,分別介紹各個模塊的功能,用VHDL語言對其進行描述,用FPGA實...
鋯石FPGA A4_Nano開發板視頻:ROM IP核的使用講解
ROM 是 read only memory的簡稱,表示只讀存儲器。只讀存儲器(ROM)是一種在正常工作時其存儲的數據固定不變,其中的數據只能讀出,不能...
鋯石FPGA A4_Nano開發板視頻:FIFO IP核的使用講解
FIFO是隊列機制中最簡單的,每個接口上都存在FIFO隊列,表面上看FIFO隊列并沒有提供什么QoS(Quality of Service,服務質量)保...
鋯石FPGA A4_Nano開發板視頻:內置IP核UART的理論原理講解
UART將要傳輸的資料在串行通信與并行通信之間加以轉換。作為把并行輸入信號轉成串行輸出信號的芯片,UART通常被集成于其他通訊接口的連結上。
基于賽靈思Virtex 6的PCI Express高速采集卡設計
本文在研究PCIExpress協議標準及其接口技術的基礎上,設計了基于Virtex-6FPGA芯片的PCIExpress高速數據采集卡,實現了外部系統與...
鋯石FPGA A4_Nano開發板視:PS/2外設IP核的應用
IP核有三種不同的存在形式:HDL語言形式,網表形式、版圖形式。分別對應我們常說的三類IP內核:軟核、固核和硬核。這種分類主要依據產品交付的方式,而這三...
TAKUMI公司:圖象IP核參考設計可用于S2C原型驗證平臺
電子發燒友網訊: 本文主要講述了TAKUMI公司的圖象IP核參考設計可用于S2C原型驗證平臺。S2C宣布,一家總部位于日本的高級圖形知識產權(IP)供應...
電子發燒友網核心提示:對SoPC的開發而言,PLD工具是必不可少的。PLD開發工具必須進一步發展,從而與技術進步和EDA產業的發展相適應。器件的復雜度在...
鋯石FPGA A4_Nano開發板視頻:內置IP核SPI的理論原理講解
SPI是串行外設接口(Serial Peripheral Interface)的縮寫,是一種高速的,全雙工,同步的通信總線,并且在芯片的管腳上只占用四根...
隨著電路規模不斷擴大,以及競爭帶來的上市時間的壓力,越來越多的電路設計者開始利用設計良好的、經反復驗證的電路功能模塊來加快設計進程。這些電路功能模塊被稱...
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