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pll技術(shù)

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pll技術(shù)技術(shù)

聊聊s域和z域之間的轉(zhuǎn)換

復(fù)變量z與復(fù)變量s之間的關(guān)系為z=esT（或s=lnz/T），其中s=σ+jω，T為采樣周期。s表示直角坐標(biāo)，z表示極坐標(biāo)

2023-10-31 標(biāo)簽：負(fù)反饋 cdr MATLAB仿真 1.5萬(wàn) 0

相位噪聲到抖動(dòng)的轉(zhuǎn)換（下）

相位噪聲轉(zhuǎn)換到抖動(dòng)的基本思想就是對(duì)相位噪聲曲線進(jìn)行積分。

2023-10-30 標(biāo)簽：分頻器 VCO 相位噪聲 4571 0

相位噪聲到抖動(dòng)的轉(zhuǎn)換（上）

相位噪聲和抖動(dòng)是對(duì)時(shí)鐘頻譜純度的兩種表述形式，一個(gè)是頻域一個(gè)是時(shí)域，從原理上來(lái)說(shuō)，它們是等效的。

2023-10-30 標(biāo)簽：時(shí)鐘抖動(dòng)RMS 相位噪聲 2737 0

提升PLL/VCO技術(shù)性能的方法

本地振蕩器（LO）是現(xiàn)代通信、汽車、工業(yè)和儀器儀表應(yīng)用中的關(guān)鍵組件。無(wú)論從基帶到RF實(shí)施上變頻還是反過(guò)來(lái)的下變頻，為汽車?yán)走_(dá)、材料檢測(cè)應(yīng)用生成掃頻，或者...

2020-10-02 標(biāo)簽：PLL技術(shù) 2325 0

淺析：采用PLL技術(shù)的接收機(jī)射頻前端的設(shè)計(jì)方案

射頻前端模塊性能關(guān)系到整個(gè)接收機(jī)的性能。本文通過(guò)對(duì)接收機(jī)進(jìn)行研究，分析了超外差接收機(jī)的特點(diǎn)，提出了一種采用PLL技術(shù)的接收機(jī)的射頻前端方案，及對(duì)射頻前端...

2019-03-14 標(biāo)簽：射頻接收機(jī)PLL技術(shù) 2002 0

壓控晶振之絕對(duì)牽引范圍簡(jiǎn)析

壓控振蕩器(VCO) 指的是輸出頻率和輸入控制電壓有關(guān)系的振蕩電路。通過(guò)控制電壓，壓控晶體振蕩器(VCXO)可在小范圍內(nèi)調(diào)整頻率，主要用于頻率調(diào)頻和頻率...

2023-03-22 標(biāo)簽：晶振振蕩電路 VCO 1454 0

影響鎖相環(huán)的性能參數(shù)主要有哪幾種呢？

鎖相環(huán)（PLL）是一種反饋控制系統(tǒng)，廣泛應(yīng)用于電子領(lǐng)域，如頻率合成、數(shù)據(jù)恢復(fù)、解調(diào)和時(shí)鐘恢復(fù)等。

2024-05-23 標(biāo)簽：鎖相環(huán)PLL技術(shù)反饋控制系統(tǒng) 1439 0

鎖相環(huán)PLL技術(shù)在通信中的應(yīng)用

鎖相環(huán)（Phase-Locked Loop，PLL）技術(shù)在通信領(lǐng)域中具有廣泛的應(yīng)用，其核心是一個(gè)反饋環(huán)路，通過(guò)不斷比較輸入信號(hào)和反饋信號(hào)的相位差來(lái)調(diào)整輸...

2024-11-06 標(biāo)簽：鎖相環(huán)通信輸入信號(hào) 955 0

鎖相環(huán)性能度量標(biāo)準(zhǔn)

鎖相環(huán)性能度量標(biāo)準(zhǔn)包括品質(zhì)因數(shù)、噪聲基底、閃爍噪聲模型。

2023-10-30 標(biāo)簽：鎖相環(huán)振蕩器鑒相器 856 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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