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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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CLB是xilinx基本邏輯單元,每個CLB包含兩個slices,每個slices由4個(A,B,C,D)6輸入LUT和8個寄存器組成。
隨著信息技術(shù)的發(fā)展,AGV(Automated Guided Vehicle,AGV)無人自動導(dǎo)航小車已被廣泛應(yīng)用于智能制造、智慧物流等場景。AGV搬運(yùn)...
板載最大支持32GB的DDR4(PL)端以及5GB DDR(PS端)。支持X16 PCIE接口,HTG-VSL1提供了三個Vita 57.4 FMC+...
I2C 總線的兩根信號線 SCL 和 SDA 需要上拉才能正常工作,當(dāng)板卡上沒有合適的硬件設(shè)置或者沒有合適的 I2Cslave 設(shè)備,我們就無法進(jìn)行 I...
Xilinx快速傅立葉變換(FFT IP)內(nèi)核實(shí)現(xiàn)了Cooley-Tukey FFT算法,這是一種計(jì)算有效的方法,用于計(jì)算離散傅立葉變換(DFT)。
PlanetSpark推出基于Xilinx的AI邊緣計(jì)算盒子
憑借其包含的中間件和對許多常見外設(shè)和接口的支持,該產(chǎn)品可以幫助開發(fā)人員快速啟動工業(yè)物聯(lián)網(wǎng)應(yīng)用、計(jì)算機(jī)視覺應(yīng)用和嵌入式視覺應(yīng)用。此外,它還可以與Plane...
UltraFast設(shè)計(jì)方法時序收斂快捷參考指南
《UltraFast 設(shè)計(jì)方法時序收斂快捷參考指南》提供了以下分步驟流程, 用于根據(jù)《UltraFast設(shè)計(jì)方法指南》( UG949 )中的建議快速完成...
2021-11-05 標(biāo)簽:Xilinx時序設(shè)計(jì) 5086 0
Xilinx賦能深維科技GIF2WebP動圖方案重新定義圖像處理未來
Xilinx? Alveo? U200加速卡助力深維科技 (DeePoly)ThunderImage轉(zhuǎn)碼解決方案提供創(chuàng)新的多媒體演示體驗(yàn)。
澎峰Artix 7 FPGA開發(fā)套件新品上線 奉送RISC-V Core開發(fā)實(shí)例
新款的RV開發(fā)板,已經(jīng)新鮮出爐啦!這次帶來的 Perf-V1開發(fā)板 ,既可以學(xué)習(xí) FPGA編程 ,也能學(xué)習(xí) RISC-V?Core設(shè)計(jì)和驗(yàn)證 。你不打算...
ZYNQ PS + PL異構(gòu)多核案例開發(fā)手冊之1axi_gpio_led_demo案例
本文主要介紹ZYNQ PS + PL異構(gòu)多核案例的使用說明,適用開發(fā)環(huán)境:Windows 7/10 64bit、Xilinx Vivado 2017.4...
DaVinci數(shù)字視頻開發(fā)平臺的主要特性及應(yīng)用分析
無電容線性放大器和視頻放大器AK4203是具有1通道視頻驅(qū)動器的音頻立體聲無電容線性驅(qū)動器。它消除了對帶有內(nèi)置電荷泵電路的大型隔直電容器的需求。AK42...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第三十章自定義IP實(shí)驗(yàn)
創(chuàng)建自己的IP核有很多好處,例如系統(tǒng)設(shè)計(jì)定制化;設(shè)計(jì)復(fù)用,可以在在IP核中加入license, 有償提供給別人使用;簡化系統(tǒng)設(shè)計(jì)和縮短設(shè)計(jì)時間。用ZYN...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十九章PL端AXI GPIO的使用
使用zynq最大的疑問就是如何把PS和PL結(jié)合起來使用,在其他的SOC芯片中一般都會有GPIO,本實(shí)驗(yàn)使用一個AXI GPIO的IP核,讓PS端通過AX...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第八章FPGA片內(nèi)FIFO讀寫測試實(shí)驗(yàn)
FIFO: First in, First out代表先進(jìn)的數(shù)據(jù)先出,后進(jìn)的數(shù)據(jù)后出。Xilinx在VIVADO里為我們已經(jīng)提供了FIFO的IP核, 我...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第一章MPSoC芯片介紹
原創(chuàng)聲明: 本原創(chuàng)教程由芯驛電子科技(上海)有限公司(ALINX)創(chuàng)作,版權(quán)歸本公司所有,如需轉(zhuǎn)載,需授權(quán)并注明出處。 適用于板卡型號: AXU2CGA...
HLS優(yōu)化設(shè)計(jì)中pipeline以及unroll指令:細(xì)粒度并行優(yōu)化的完美循環(huán)
HLS 優(yōu)化設(shè)計(jì)的最關(guān)鍵指令有兩個:一個是流水線 (pipeline) 指令,一個是數(shù)據(jù)流(dataflow) 指令。正確地使用好這兩個指令能夠增強(qiáng)算法...
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