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Xilinx是全球領先的可編程邏輯完整解決方案的供應商。Xilinx研發、制造并銷售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統級功能的IP（Intellectual Property）核。

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xilinx技術

基于System Generator的FPGA開發總結

前一陣一直在忙，所以沒有來得及寫博文。弄完雜七雜八的事情，又繼續FPGA的研究。使用Verilog HDL語言和原理圖輸入來完成FPGA設計的方法都試驗...

2017-02-11 標簽：FPGA Xilinx 8584 0

借助Intel i7 處理器和 Xilinx FPGA實現的開放式毫米波測試平臺

美國國家儀器公司（NI）和德國德累斯頓工業大學開展合作，通過世界上第一臺開放式毫米波測試平臺來拓展德累斯頓5G實驗室（D5GL），該測試平臺能實時處理超...

2017-02-11 標簽：FPGA Xilinx Intel 1134 0

ZedBoard學習手記（三）為自定義外設編寫裸奔控制軟件

由于Xilinx已經為我們做了大部分的鋪墊工作，因此裸奔控制外設這一步就顯得十分簡單了，如果不用Linux和圖形界面顯示，大概我的作品早早的就完成了吧。

2017-02-11 標簽：Linux Xilinx ZedBoard 1054 0

Xilinx DDR3控制器接口帶寬利用率測試（四

描述：在此項測試中，發起四次讀寫訪問，其中讀寫操作分別間隔開，四次讀寫操作訪問的地址都是同一個，由此觀察讀寫切換引入的帶寬開銷。

2017-02-11 標簽：DDR3 Xilinx 5733 0

Xilinx DDR3控制器接口帶寬利用率測試（三）

描述：在此項測試中，每個Bank只訪問一次，接著依次訪問其它Bank。DDR3有限制在一定時間內可以輸入的Bank打開指令個數，即在一定時間內只允許輸入...

2017-02-11 標簽：DDR3 Xilinx 4504 0

Xilinx DDR3控制器接口帶寬利用率測試(二）

描述：單Bank內行切換時，每次打開一個Row，進行一次寫操作以后，必須重新打開另外一個Row，才能進行該Row的寫操作。兩個Row打開操作有時間間隙要...

2017-02-11 標簽：DDR3 Xilinx 2939 0

ZedBoard學習手記（九）在ZedBoard上運行QT圖形軟件

在Zynq平臺上運行QT其實與PC無異，都需要相應的執行環境，只不過PC上的QT Lib可以使用QT SDK自動安裝配置，而Zynq平臺上的QT Lib...

2017-02-11 標簽：Xilinx Zynq ZedBoard 1594 0

Transceiver對電源文波噪聲的要求

XILINX在Transceiver用戶手冊里提出了對模擬電源的文波噪聲要求：10mV p-p 10kHz~80Mhz。大多數客戶一看到該指標要求的第一...

2017-02-10 標簽：Xilinx Transceiver 電源文波 2326 0

參考時鐘對SERDES性能的影響

我們知道，SERDES對參考時鐘有嚴格的相位噪聲性能要求。通常，SERDES供應商會根據其SERDES采用的PLL以及CDR架構特點，以及性能數據，提出...

2017-02-10 標簽：Xilinx SERDES 參考時鐘 6450 0

Xilinx 7系列FPGA使用之CLB探索（一）

7系列FPGA是Xilinx新推出的基于28nm工藝的FPGA，其中包含三個系列：Artix、Kintex和Virtex。因項目要使用kintex7為平...

2017-02-10 標簽：FPGA Xilinx CLB 5406 0

6 FPGA LX9 MicroBoard成為學習FPGA的另一低成本方法

昨天為寫博客搜索關于miniSpartan6+開發板的一些信息，我偶然看到$89的 Xilinx Spartan-6 FPGA LX9 MicroBoa...

2017-02-10 標簽：賽靈思 Xilinx 1230 0

基于ZYNQ7000的交叉編譯工具鏈Qt+OpenCV+ffmpeg等庫支持總結

最近剛剛接觸XILINX的ZYNQ板，剛接觸沒有十天。XILINX定位它為SOC，我也很認同，起碼比TI定位MPU為SOC強很多。

2017-02-10 標簽：Xilinx ZYNQ ZYNQ7000 4838 0

ZedBoard上的點燈簽名實驗（二）：創建自定義IP

如果想使用Xilinx組件從頭開始創建嵌入式工程，一般是從PlanAhead開始，然后啟動XPS。

2017-02-10 標簽：Xilinx ZedBoard 999 0

如果是的話，取代它的將會是什么？

SemiWiki的Eric Esteve剛剛發表一篇博客，標題為 “再見，DDRn協議”。博客中Esteve承認這份博客將引起轟動，且聲稱 “ 今后數年...

2017-02-10 標簽：Xilinx DDR4 735 0

“軟”定義規范環境（SDNet）擴展至數據層實現高速SDN

一個月前Xilinx 新興技術研究會上，斯坦福大學計算機科學系教授Nick McKeown教授說“未來的SDN芯片看起來將類似FPGA或某種可以在FPG...

2017-02-10 標簽：FPGA Xilinx SDN 874 0

利用Xilinx UltraScale架構大幅提升生產力

許多市場和應用都對系統帶寬和處理功能需求顯著增長。無論是有線或無線通信、數字視頻還是圖像處理，更高的數據吞吐量要求都實現相同的結果，那就是所有系統組件...

2018-07-12 標簽：xilinx ultrascale 1839 0

Xilinx ISE使用錯誤和警告匯總

Xilinx ISE使用錯誤和警告匯總，具體的跟隨小編一起來了解一下。

2018-07-13 標簽：xilinx ise 6760 0

Xilinx FPGA普通IO作PLL時鐘輸入

普通IO可以通過BUFG再連到PLL的時鐘輸入上,但要修改PLL的設置 input clk的選項中要選擇"No Buffer";

2017-02-09 標簽：FPGA 賽靈思 Xilinx 7428 0

使用Xilinx 20nm工藝的UltraScale FPGA來降低功耗的19種途徑

在絕大部分使用電池供電和插座供電的系統中，功耗成為需要考慮的第一設計要素。Xilinx決定使用20nm工藝的UltraScale器件來直面功耗設計的挑戰...

2018-07-14 標簽：xilinx ultrascale 6122 0

Xilinx FPGA編程技巧常用時序約束介紹

Xilinx FPGA編程技巧常用時序約束介紹，具體的跟隨小編一起來了解一下。

2018-07-14 標簽：xilinx fpga編程 4810 0

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