數字PLL中會利用到JK觸發器，JK觸發器的J=1,K=1時，JK觸發器輸出取反，即二分頻。

當沒有進位/借位脈沖信號時，它把外部參考時鐘進行二分頻；

當有進位脈沖信號CARRY時，則在輸出的二分頻信號中插入半個脈沖，以提高輸出信號的頻率；

當有借位脈沖信號BORROW時，則在輸出的二分頻信號中減去半個脈沖，以降低輸出信號的頻率。

DRC、LVS run一下：

最近準備集成64位雙核RISCV處理器、LPDDR4、MIPI、ISP、VPU，開發一款多媒體SoC芯片，TSMC12nm工藝。數據涉密，架構開放討論。

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責任編輯：彭菁