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ADF4107 PLL頻率合成器技術手冊

要長高 ? 2025-04-27 15:30 ? 次閱讀

概述
ADF4107頻率合成器在無線接收機和發射機的上變頻和下變頻部分中,可用來實現本振。它由低噪聲數字鑒頻鑒相器(PFD)、精密電荷泵、可編程參考分頻器、可編程A和B計數器以及雙模預分頻器(P/P+1)組成。A(6位)、B(13位)計數器與雙模預分頻器(P/P+1)配合,可實現N分頻器(N = BP + A)。此外,14位參考分頻器(R分頻器)允許PFD輸入端的REFIN頻率為可選值。如果頻率合成器與外部環路濾波器和電壓控制振蕩器(VCO)一起使用,則可以實現完整的鎖相環(PLL)。其帶寬極高,因此許多高頻系統可以省去倍頻器,從而簡化系統架構并降低成本。
數據表:*附件:ADF4107 PLL頻率合成器技術手冊.pdf
特性

  • 帶寬:7.0 GHz
  • 2.7 V至3.3 V電源供電
  • 獨立的電荷泵電源(VP)可在3 V系統中提供擴展的調諧電壓
  • 可編程雙模預分頻器:8/9、16/17、32/33、64/65
  • 可編程電荷泵電流
  • 可編程反沖防回差脈沖寬度
  • 三線式串行接口
  • 模擬和數字鎖定檢測
  • 硬件和軟件省電模式

框圖
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時序特征
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引腳配置描述
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典型性能特征
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功能說明

參考輸入部分

參考輸入級如圖17所示。SW1和SW2通常為閉合狀態,SW3通常為斷開狀態。當啟動掉電模式時,SW3閉合,SW1和SW2斷開。這確保了在掉電時參考引腳((REF_{IN}))不會有負載。

image.png

射頻輸入部分

射頻輸入級如圖18所示。其后接一個兩級限幅放大器,以生成預分頻器所需的電流模式邏輯(CML)時鐘電平。

image.png

預分頻器(P/P + 1)

雙模數預分頻器(P/P + 1)與A計數器和B計數器配合,可實現較大的分頻比N((N = BP + A) )。雙模數預分頻器以CML電平工作,從射頻輸入級獲取時鐘信號,并將其分頻到適合CMOS A計數器和B計數器處理的頻率。預分頻器在軟件中可設置為8/9、16/17、32/33或64/65 ,基于同步4/5核心。對于完全連續的輸出頻率,存在一個由P(預分頻器值)決定的最小分頻比,其值為((P^2 - P)) 。

A計數器和B計數器

A計數器和B計數器(采用CMOS工藝)與雙模數預分頻器配合,可在鎖相環(PLL)反饋回路中實現較寬范圍的分頻比。當預分頻器的輸出為300 MHz或更低時,這些計數器可正常工作。因此,對于4.2 GHz的射頻輸入頻率,預分頻器值16/17有效,但8/9無效。

脈沖吞咽功能
A計數器和B計數器與雙模數預分頻器配合,能夠生成間隔僅為參考頻率除以R的輸出頻率。壓控振蕩器(VCO)頻率的計算公式為:image.png

其中:

  • (f_{VCO})是外部壓控振蕩器(VCO)的輸出頻率。
  • (P)是雙模數預分頻器的模數(如8/9、16/17等 )。
  • (B)是13位二進制計數器的預設分頻比(3到8191)。
  • (A)是6位吞咽計數器的預設分頻比(0到63)。
  • (f_{REFIN})是外部參考頻率振蕩器的頻率。
  • (R)是14位二進制可編程參考計數器的預設分頻比(1到16,383)。

image.png

R計數器

14位R計數器可對輸入參考頻率進行分頻,以產生送往鑒頻鑒相器(PFD)的參考時鐘。允許的分頻比范圍是1到16,383 。

鑒頻鑒相器和電荷泵

鑒頻鑒相器(PFD)接收來自R計數器和N計數器((N = BP + A) )的輸入,并輸出一個與兩者之間相位和頻率差成正比的信號。圖20是簡化示意圖。鑒頻鑒相器包含一個可編程延遲元件,用于控制抗反沖脈沖的寬度。此脈沖功能確保了鑒頻鑒相器傳遞函數中不存在死區,并將相位噪聲以及參考雜散降至最低。R計數器鎖存(ABP2和ABP1)中的兩位控制脈沖寬度(見表9)。

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