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      FPGA技術(shù)江湖

      文章：219 被閱讀：64.1w 粉絲數(shù)：64 關(guān)注數(shù)：0 點(diǎn)贊數(shù)：18

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      最實(shí)用的Modelsim使用及仿真的基本步驟

      后仿真也稱為時(shí)序仿真或者布局布線后仿真，是指電路已經(jīng)映射到特定的工藝環(huán)境以后，綜合考慮電路的路徑延遲....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 03-06 09:58 ?11564次閱讀
      最實(shí)用的Modelsim使用及仿真的基本步驟

      優(yōu)秀的Verilog/FPGA開源項(xiàng)目開發(fā)-CAN通信篇

      CAN總線有兩個(gè)ISO國際標(biāo)準(zhǔn)：ISO11898 和 ISO11519。
      的頭像 FPGA技術(shù)江湖 發(fā)表于 02-22 09:32 ?2714次閱讀
      優(yōu)秀的Verilog/FPGA開源項(xiàng)目開發(fā)-CAN通信篇

      高級(jí)設(shè)計(jì)：SDR SDRAM驅(qū)動(dòng)設(shè)計(jì)

      隨機(jī)訪問存儲(chǔ)器（RAM）分為靜態(tài)RAM（SRAM）和動(dòng)態(tài)RAM（DRAM）。由于動(dòng)態(tài)存儲(chǔ)器存儲(chǔ)單元的....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 01-19 15:47 ?2832次閱讀
      高級(jí)設(shè)計(jì)：SDR SDRAM驅(qū)動(dòng)設(shè)計(jì)

      PCB設(shè)計(jì)（二）：漢化及設(shè)計(jì)

      器件庫的制作，也分為兩個(gè)部分，原理圖庫和封裝庫。原理圖庫是我們在原理圖中看到的圖示。封裝庫是我們器件....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 01-10 15:52 ?874次閱讀
      PCB設(shè)計(jì)（二）：漢化及設(shè)計(jì)

      阿特·德吉亞斯變革集成電路設(shè)計(jì)

      計(jì)算機(jī)歷史博物館2009年的口述歷史表明，他在那里開發(fā)了用多路復(fù)用器設(shè)計(jì)邏輯的工具。他和一位設(shè)計(jì)師朋....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 12-20 10:23 ?1099次閱讀

      系統(tǒng)模塊SOM能否成為FPGA的未來形態(tài)？

      我認(rèn)為FPGA的主要優(yōu)勢有很多，但我認(rèn)為排名前三的優(yōu)勢分別是：靈活的輸入/輸出，確定性，低時(shí)延。
      的頭像 FPGA技術(shù)江湖 發(fā)表于 12-09 09:38 ?1131次閱讀

      基于FPGA的UART控制器設(shè)計(jì)

      串口的出現(xiàn)是在1980年前后，數(shù)據(jù)傳輸率是115kbps～230kbps。串口出現(xiàn)的初期是為了實(shí)現(xiàn)連....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 12-04 09:08 ?1637次閱讀
      基于FPGA的UART控制器設(shè)計(jì)

      PCB設(shè)計(jì)（一）：軟件安裝及破解

      在此，我們此次來介紹一下印制電路板的制作。所使用的軟件為Altium Designer。這款軟件將傳....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 11-12 09:19 ?1357次閱讀
      PCB設(shè)計(jì)（一）：軟件安裝及破解

      204B實(shí)戰(zhàn)應(yīng)用-LMK04821代碼詳解

      通過閱讀LMK04821數(shù)據(jù)手冊，我們可以從中知道，可以通過SPI協(xié)議對LMK04821進(jìn)行寄存器的....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 11-07 17:40 ?1771次閱讀
      204B實(shí)戰(zhàn)應(yīng)用-LMK04821代碼詳解

      VGA接口驅(qū)動(dòng)設(shè)計(jì)

      VGA（Video Graphics Array）視頻圖形陣列是IBM于1987年提出的一個(gè)使用模擬....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 10-26 10:06 ?1900次閱讀
      VGA接口驅(qū)動(dòng)設(shè)計(jì)

      基于Corundum架構(gòu)的100G RDMA網(wǎng)卡設(shè)計(jì)

      傳統(tǒng)TCP/IP技術(shù)處理數(shù)據(jù)包需通過操作系統(tǒng)和其他軟件層，導(dǎo)致數(shù)據(jù)在系統(tǒng)內(nèi)存、處理器緩存和網(wǎng)絡(luò)控制器....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 10-24 10:47 ?1982次閱讀
      基于Corundum架構(gòu)的100G RDMA網(wǎng)卡設(shè)計(jì)

      如何脫離Vivado建立單獨(dú)仿真環(huán)境軟件呢？

      FPGA項(xiàng)目開發(fā)的過程中，需要完成設(shè)計(jì)代碼開發(fā)、驗(yàn)證環(huán)境搭建、仿真分析、板級(jí)驗(yàn)證等操作，在這個(gè)過程中....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 09-27 09:25 ?1815次閱讀
      如何脫離Vivado建立單獨(dú)仿真環(huán)境軟件呢？

      使用FPGA做的開源示波器

      其實(shí)用FPGA做的示波器有很多，開源的相對較少，我們今天就簡單介紹一個(gè)使用FPGA做的開源示波器。
      的頭像 FPGA技術(shù)江湖 發(fā)表于 08-29 09:30 ?1813次閱讀

      基于FPGA的RTC實(shí)時(shí)時(shí)鐘系統(tǒng)設(shè)計(jì)

      RTC（real time clock）實(shí)時(shí)時(shí)鐘，在電腦、手機(jī)等電子產(chǎn)品中都有，應(yīng)用較多。它的主要作....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 08-23 09:29 ?1689次閱讀
      基于FPGA的RTC實(shí)時(shí)時(shí)鐘系統(tǒng)設(shè)計(jì)

      狀態(tài)機(jī)的一段式、二段式、三段式的區(qū)別

      本篇文章描述狀態(tài)機(jī)的一段式、二段式、三段式區(qū)別.
      的頭像 FPGA技術(shù)江湖 發(fā)表于 08-21 09:25 ?10995次閱讀
      狀態(tài)機(jī)的一段式、二段式、三段式的區(qū)別

      設(shè)計(jì)一個(gè)計(jì)數(shù)器來講解時(shí)序邏輯

      時(shí)序邏輯是Verilog HDL 設(shè)計(jì)中另一類重要應(yīng)用。從電路特征上看來，其特點(diǎn)為任意時(shí)刻的輸出不僅....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 08-14 09:28 ?1655次閱讀
      設(shè)計(jì)一個(gè)計(jì)數(shù)器來講解時(shí)序邏輯

      xilinx ZYNQ7000系列基本開發(fā)流程之PS端

      ZYNQ 芯片分為 PL 和 PS， PS 端的 IO 分配相對是固定的，不能任意分配，雖然 PS ....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 08-11 09:36 ?12084次閱讀
      xilinx ZYNQ7000系列基本開發(fā)流程之PS端

      如何設(shè)計(jì)一顆AI芯片？AI芯片設(shè)計(jì)入門方案

      機(jī)器學(xué)習(xí)（ML）已經(jīng)在在線活動(dòng)中變得無處不在。近年來，這些模型的規(guī)模和復(fù)雜性大幅增長，這有助于提高預(yù)....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 08-10 09:19 ?4504次閱讀
      如何設(shè)計(jì)一顆AI芯片？AI芯片設(shè)計(jì)入門方案

      基于FPGA Vivado的數(shù)字鐘設(shè)計(jì)（附源工程）

      工程建立完畢，我們需要將lab2這個(gè)工程所需的IP目錄文件夾復(fù)制到本工程文件夾下。本工程需要兩個(gè)IP....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 07-29 10:06 ?5359次閱讀
      基于FPGA Vivado的數(shù)字鐘設(shè)計(jì)（附源工程）

      Vivado系列之TCL549驅(qū)動(dòng)設(shè)計(jì)

      ? 系統(tǒng)性的掌握技術(shù)開發(fā)以及相關(guān)要求，對個(gè)人就業(yè)以及職業(yè)發(fā)展都有著潛在的幫助，希望對大家有所幫助。本....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 07-27 09:25 ?1952次閱讀
      Vivado系列之TCL549驅(qū)動(dòng)設(shè)計(jì)

      10行代碼輕松在ZYNQ MP上實(shí)現(xiàn)圖像識(shí)別的步驟

      Xilinx Vitis-AI 是用于 Xilinx 硬件平臺(tái)上的 AI 推理的開發(fā)堆棧。它由優(yōu)化的....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 07-04 09:20 ?2077次閱讀
      10行代碼輕松在ZYNQ MP上實(shí)現(xiàn)圖像識(shí)別的步驟

      英特爾Quartus Prime軟件v23.1上線

      此外，Nios V/g 內(nèi)核還有著更大的軟件生態(tài)系統(tǒng)，包括 FreeRTOS 和 Zephyr RT....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 07-03 11:01 ?1408次閱讀

      看門狗在Zynq MPSoC上的使用技巧

      在Zynq MPSoC的器件里，PS (Processing System )集成了三個(gè)看門狗，分別....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-30 09:47 ?2146次閱讀
      看門狗在Zynq MPSoC上的使用技巧

      使用CCIX進(jìn)行高速緩存一致性主機(jī)到FPGA接口的評(píng)估

      Chiplet技術(shù)和NoC技術(shù)目前已經(jīng)成為解決摩爾定律無法延續(xù)的一種重要方法，現(xiàn)在的CPU芯片對外的....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-29 09:56 ?1350次閱讀
      使用CCIX進(jìn)行高速緩存一致性主機(jī)到FPGA接口的評(píng)估

      如何使用Python腳本調(diào)試賽靈思PCIe設(shè)計(jì)？

      現(xiàn)在，您不僅可以使用 Python 腳本執(zhí)行調(diào)試分析，更重要的是，借由 Vivado ILA 所生成....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-26 09:20 ?1723次閱讀
      如何使用Python腳本調(diào)試賽靈思PCIe設(shè)計(jì)？

      使用Vitis AI在Zynq MP上實(shí)現(xiàn)手勢識(shí)別

      FPGA得益于其高可編程性以及低延遲，低功耗的特點(diǎn)，在機(jī)器學(xué)習(xí)的推理領(lǐng)域已獲得了廣泛的關(guān)注。在過去，....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-25 10:52 ?1570次閱讀
      使用Vitis AI在Zynq MP上實(shí)現(xiàn)手勢識(shí)別

      如何使Linux網(wǎng)絡(luò)協(xié)議棧中RFS功能優(yōu)化 MPSoC APU 的并行處理能力

      ? 本文介紹如何使能 Linux 網(wǎng)絡(luò)協(xié)議棧中的 RFS(receive flow steering....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-17 08:59 ?1147次閱讀
      如何使Linux網(wǎng)絡(luò)協(xié)議棧中RFS功能優(yōu)化 MPSoC APU 的并行處理能力

      將RTL模塊添加到Block Design的步驟

      使用Vivado Block Design設(shè)計(jì)解決了項(xiàng)目繼承性問題，但是還有個(gè)問題，不知道大家有沒有....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-11 16:27 ?4519次閱讀
      將RTL模塊添加到Block Design的步驟

      FPGA零基礎(chǔ)學(xué)習(xí)之Vivado-FIFO使用教程

      FIFO的英文全稱叫做First in First out，即先進(jìn)先出。這也就決定了這個(gè)IP核的特殊....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-09 09:38 ?4925次閱讀
      FPGA零基礎(chǔ)學(xué)習(xí)之Vivado-FIFO使用教程

      FPGA零基礎(chǔ)學(xué)習(xí)之Vivado-ROM使用教程

      系統(tǒng)性的掌握技術(shù)開發(fā)以及相關(guān)要求，對個(gè)人就業(yè)以及職業(yè)發(fā)展都有著潛在的幫助，希望對大家有所幫助。本次帶....
      的頭像 FPGA技術(shù)江湖 發(fā)表于 06-07 12:27 ?1988次閱讀
      FPGA零基礎(chǔ)學(xué)習(xí)之Vivado-ROM使用教程
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