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片上系統（ System on Chip，SoC）技術已成為超大規模集成電路發展的趨勢，SoC芯片的功能日益復雜，片上集成的外設數目越來越多。中斷控制器作為連接外設和CPU之間的橋梁，能夠提高CPU的工作效率，改善CPU與外設的協調性。同時，SoC芯片具有集成度高、專用性強的特點，需設計適應于該芯片的中斷控制器。
CPU支持中斷請求（Interrupt Request，IRQ）和快速中斷請求（ Fast Interrupt Request，FIQ）2種類型的中斷。與IRQ相比，FIQ有額外的5個物理寄存器（R8_fiq - R12_fiq），能減少CPU處理中斷時上下文切換的時間開銷，通常用于高速數據傳輸和通道處理等實時性要求較高的場合。
為降低多個中斷源被分配為快速中斷請求（ FIQ）時的時間開銷，設計一種用于FIQ中斷源識別和優先級仲裁的向量中斷控制器。采用Verilog語言完成硬件描述，通過Modelsim仿真和FPGA驗證，實現基于SMIC0. 13 pdm CMOS工藝的綜合布局布線工作。仿真和驗證結果表明，該向量中斷控制器的面積為0.107 mIT12，平均功耗為3.56 mW，工作頻率為80 MHz，可滿足移動通信寬帶射頻片上系統芯片的實時性需求。
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