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低密度奇偶校驗碼（Low-Density-Parity-Checkcodes，簡稱LDPC碼）是第四代通信系統強有力的競爭者，它是一種逼近香農限的線性分組碼，譯碼的復雜度較低；但它的直接編碼運算量較大，通常具有碼長的二次方復雜度。本文創新點在于如何構造有效的編碼，以降低LDPC碼的編碼復雜度；并研究和設計了用大規模集成電路去實現一個LDPC碼的編碼。文章中以（12,3,6）碼為例，采用基于下三角矩陣的有效編碼算法，通過重排列的順序得到一個新的校驗矩陣，以控制編碼運算量為線性復雜度，并在QuartusII5.0軟件平臺上采用基于CPLD的VerilogHDL語言編程仿真實現了有效編碼的過程，給出了編碼的結構圖和仿真波形，為LDPC碼的硬件實現和實際應用提供了依據。
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